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參數(shù)資料
| 型號： | OR3T165-5B600 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1024 CLBS, 120000 GATES, PBGA600 |
| 封裝： | BGA-600 |
| 文件頁數(shù)： | 20/210頁 |
| 文件大小： | 2138K |
| 代理商： | OR3T165-5B600 |
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Preliminary Data Sheet, Rev. 1
ORCA Series 3 FPGAs
September 1998
116
Lucent Technologies Inc.
Timing Characteristics (continued)
Notes:
All timing values for the PCM are advance information.
Shaded values are advance information and are valid for OR3Txxx devices only.
Table 49. Programmable Clock Manager (PCM) Timing Characteristics (Advance Information)
OR3Cxx Commercial: VDD = 5.0 V ± 5%, 0 °C
≤TA < 70 °C; Industrial: VDD = 5.0 V ± 10%, –40 °C < TA < +85 °C.
OR3Txxx Commercial: VDD = 3.0 V to 3.6 V, 0 °C
< TA < 70 °C; Industrial: VDD = 3.0 V to 3.6 V, –40 °C < TA < +85 °C.
Parameter
Symbol
Speed
Unit
-4
-5
-6
MinMax
Min
Max
Input Clock Frequency
Output Clock Frequency
Input Clock Duty Cycle
Output Clock Duty Cycle
FPCMI
FPCMO
PCMI_DUTY
PCMO_DUTY
5.00
40.00
3.13
80.00
60.00
96.90
5.00
40.00
3.13
80.00
60.00
96.90
5.00
40.00
3.13
80.00
60.00
96.90
MHz
%
PCM Acquisition Time (CLK In to LOCK)
PCM On Delay (config. Done-H, WE to PCM ready to acquire clock)
PCM Off Delay (config. Done-L, WE to PCM power off)
PCM Off Cycle Time (PCM Off to PCM On)
PCM Clock In to PCM Clock Out Bypass Delay (CLK In to ECLK)
PCM Clock In to PCM Clock Out Bypass Delay (CLK In to SCLK)
PIC Clock In Delay (corner pad to PCM phase detect, bypass DIV0):
OR3C/T55
OR3C/T80
OR3T125
PIC Clock-in Delay (corner pad to PCM phase detect using DIV0):
OR3C/T55
OR3C/T80
OR3T125
Routed Clock-in Delay (routing to PCM phase detect, bypass DIV0)
Routed Clock-in Delay (routing to PCM phase detect, using DIV0)
System Clock-out Delay (PCM oscillator to SCLK output at PCM)
ExpressCLK Feedback In Delay (ECLK to PCM FB input at
phase detect):
OR3C/T55
OR3C/T80
OR3T125
PCM_ACQ
PCMON_DEL
PCMOFF_DEL
TC_PCM
PCMBYE_DEL
PCMBYS_DEL
PICCLK_DEL
PICCLKD_DEL
RTCK_DEL
RTCKD_DEL
PCMSCK_DEL
PCMFB_DEL
—
200.0
0
—
2.00
100.0
0
—
3.40
2.50
3.10
TBD
3.90
TBD
1.30
2.70
0.60
3.90
TBD
—
200.0
0
—
2.00
100.0
0
—
2.70
2.00
2.50
TBD
3.20
TBD
1.10
2.20
0.50
3.10
TBD
—
200.0
0
—
2.00
100.0
0
—
2.20
1.70
2.10
TBD
2.70
TBD
0.90
1.90
0.40
2.60
TBD
s
ns
(500/FPCMI) + 3
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