Figure 8. Output Voltage Amplitude (VOUTPP
參數(shù)資料
型號： NBSG16VSMNHTBG
廠商： ON Semiconductor
文件頁數(shù)： 3/14頁
文件大小： 0K
描述： IC RCVR/DVR SIGE DIFF 16QFN
標準包裝： 100
類型： 收發(fā)器
應(yīng)用： 儀表
安裝類型： 表面貼裝
封裝/外殼： 16-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 16-QFN（3x3）
包裝： 帶卷 (TR)
配用： NBSG16VSBAEVBOS-ND - BOARD EVAL BBG NBSG16VSBA
NBSG16VS
http://onsemi.com
11
INPUT FREQUENCY (GHz)
Figure 8. Output Voltage Amplitude (VOUTPP) / RMS Jitter vs. Input Frequency (fin) at Ambient Temperature
(Typical) See Tables 8 and 10 (VCC = 0 V; VEE = 3.465 V to 3.0 V or VCC = 3.0 V to 3.465 V; VEE = 0 V
OUTPUT
VOL
TA
GE
AMPLITUDE
(mV)
JITTER
OUT
ps
(RMS)
0
100
200
300
400
500
600
700
800
900
123
45
67
89
10
11
12
0
1
2
3
4
5
6
7
8
9
RMS JITTER
VCTRL = VCC 1 V
OUTPUT PP SPEC
(AMPLITUDE GUARANTEE)
VCTRL = VCC 2 V
VCTRL = VCC 0 V
INPUT FREQUENCY (GHz)
100
200
300
400
500
600
700
800
123
4
5
6
789
10
11
12
2
3
4
5
6
7
8
9
Figure 9. Output Voltage Amplitude (VOUTPP) / RMS Jitter vs. Input Frequency (fin) at Ambient Temperature
(Typical) See Tables 9 and 11 (VCC = 0 V; 3.0 V VEE 2.375 V or 2.375 V VCC 3.0 V; VEE = 0 V)
OUTPUT
VOL
TAGE
AMPLITUDE
(mV)
0
1
0
RMS JITTER
VCTRL = VCC 1 V
OUTPUT PP SPEC
(AMPLITUDE GUARANTEE)
VCTRL = VCC 2 V
VCTRL = VCC 0 V
JITTER
OUT
ps
(RMS)
Figure 10. AC Reference Measurement
D
Q
tPHL
tPLH
VINPP = VIH(D) VIL(D)
VOUTPP = VOH(Q) VOL(Q)
相關(guān)PDF資料
PDF描述
NBSG16MNHTBG IC RCVR/DRVR RSECL SIGE DF 16QFN
NBSG16VSMNR2G IC RCVR/DRIVER SIGE DIFF 16QFN
LFXP20C-4F388C IC FPGA 19.7KLUTS 268I/O 388-BGA
LFXP20C-3F388I IC FPGA 19.7KLUTS 268I/O 388-BGA
LFXP20E-4FN388C IC FPGA 19.7KLUTS 388FPBGA
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參數(shù)描述
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NBSG16VSMNR2G 功能描述:緩沖器和線路驅(qū)動器 2.5V/3.3V SiGe Diff w/Variable Output RoHS:否 制造商:Micrel 輸入線路數(shù)量:1 輸出線路數(shù)量:2 極性:Non-Inverting 電源電壓-最大:+/- 5.5 V 電源電壓-最小:+/- 2.37 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MSOP-8 封裝:Reel
NBSG53A 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:2.5V/3.3V SiGe Selectable Differential Clock and Data D Flip-Flop/Clock Divider with Reset and OLS
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NBSG53A_06 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:2.5V/3.3V SiGe Selectable Differential Clock and Data D Flip−Flop/Clock Divider with Reset and OLS
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