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參數(shù)資料
| 型號： | MT92220 |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 1023 Channel Voice Over IP/AAL2 Processor |
| 中文描述： | ATM NETWORK INTERFACE, PBGA608 |
| 封裝： | 31 X 31 MM, 2.50 MM HEIGHT, MS-034, EPBGA-608 |
| 文件頁數(shù)： | 3/210頁 |
| 文件大小： | 1536K |
| 代理商： | MT92220 |
第1頁第2頁當前第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁
Data Sheet
MT92220
3
Zarlink Semiconductor Inc.
Color Code
In this document, the following color code is used:
Fields in red are initialized by software when the structure is created, and are written back by the hardware.
Fields in black are initialized by software when the structure is created, and are never written back by the
hardware.
Fields in dark yellow are initialized by software when the structure is created and are written back at the
same value by the hardware
.
Document Organization
This data sheet is divided into the following sections:
CPU Interface
(Chapter 3.0) describes the main external interface of the MT92220 chip.
Network Interface
(Chapter 4.0) describes the interface to the 3 different types of link interfaces, Ethernet,
UTOPIA, and Packet over SONET, that are supported.
Link Layers
(Chapter 5.0) describes the 3 different types of link layers, Ethernet, ATM AAL5, and Packet
over SONET, that are supported.
RX/TX Data Flows
(Chapter 6.0) describes the data flows for all packets received and transmitted.
Packet Identification
(Chapter 7.0) describes the process by which packets are identified.
TX/RX AAL2 VC Treatment
(Chapter 8.0) describes the treatment of AAL2 mini-packets and cells as they
are transmitted and received from the network.
Packet Assembly
(Chapter 9.0) describes the collected bytes written in the circular buffers by the TX TDM,
and how they are assembled into RTP or AAL2 packets.
Packet Disassembly
(Chapter 10.0) describes how RTP and AAL2 packets are transformed into PCM
bytes, ADPCM samples, or HDLC/CPU-destined mini-packets.
TX/RX TDM Data Paths
(Chapter 11.0) describes the data paths for all bytes transmitted and received with
the H.110 interface.
H.110 Interface
(Chapter 12.0) describes the compatibility of the TDM interface with the H.110 bus.
Clocking
(Chapter 13.0) describes the clocks used for the Network Interface and the SAR portion of the
device.
Pin-out
is in Chapter 14.0.
Electrical Characteristics
(Chapter 15.0) describes the electrical characteristics of all the interfaces.
Register List and Memory Map are contained in the MT92220 Design Manual.
This shade denotes a Reserved Field.
This shade denotes an Unimplemented Field.
The field outlined in red is only written back by the chip when one of the bits,
contained within the field and in red, was set and will then be cleared by the
chip when it is done acting upon the set request bit.
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PDF描述 |
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