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參數資料
| 型號： | MT90882BP1N |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | TDM to Packet Processors |
| 中文描述： | TDM到分組處理器 |
| 文件頁數： | 86/97頁 |
| 文件大?。?/td> | 702K |
| 代理商： | MT90882BP1N |
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MT90880/1/2/3
Data Sheet
86
Zarlink Semiconductor Inc.
Figure 42 - WAN Bus Clock Master Mode at 2.048 Mbs - Generic E1 Mode
Figure 43 - WAN Bus Clock Master Mode Timing at 8.192 Mbs
10.2 Local TDM Interface
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
Clock C16OB frequency
f
C16F
16.384
MHz
Clock C16OB High Width
t
C16H
30
ns
Clock C16OB Low Width
t
C16L
30
ns
Clock C8OB frequency
f
C8F
8.192
MHz
Clock C8OB High Width
t
C8H
61
ns
Clock C8OB Low Width
t
C8L
61
ns
Clock C4OB frequency
f
C4F
4.096
MHz
Table 33 - Local TDM Interface Timing
Channel 31 Bit 0
Channel 0 Bit 7
Channel 0 Bit 6
Ch 31 Bit 0
Ch 0 Bit 7
Ch 0 Bit 6
tSTOD
tSTOD
tSTOD
tFOD
tFOD
tC2L
tC2H
tSTIH
tSTIS
tSTIH
tSTIS
tSTIH
tSTIS
WAN_CLKO
WAN_FRMO
WAN_STI
WAN_STO
Channel 31 Bit 0
Channel 0 Bit 7
Channel 0 Bit 6
Ch 31 Bit 0
Ch 0 Bit 7
Ch 0 Bit 6
tSTOD
tSTOD
tSTOD
tFOD
tFOD
tC2L
tC2H
tSTIH
tSTIS
tSTIH
tSTIS
tSTIH
tSTIS
WAN_CLKO
WAN_FRMO
WAN_STI
WAN_STO
相關PDF資料 |
PDF描述 |
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參數描述 |
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