參數(shù)資料
型號(hào): MSM66587ATS-K
廠商: OKI ELECTRIC INDUSTRY CO LTD
元件分類: 微控制器/微處理器
英文描述: 16-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP100
封裝: 14 X 14 MM, 0.50 MM PITCH, PLASTIC, TQFP-100
文件頁數(shù): 42/269頁
文件大?。?/td> 1378K
代理商: MSM66587ATS-K
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8 - 2
MSM66587 Family User's Manual
Chapter 8 Time-Base Counter (TBC)
8.1
1/n Counter
A 4-bit auto-reload timer that uses CLK as its input clock is provided to allow the same clock pulse
(TBCCLK) to be supplied to TBC even when oscillation is changed. The 1/n counter is configured
from a 4-bit counter (TBCKDVC) and a 4-bit register (TBCKDVR) that stores the reload value.
7
6
5
0
1
2
3
4
TBCKDVC
11
1
0
1
Reset state
— indicates bits that are not provided.
They will be read as 1.
Address : 011EH
R/W access : R
TBCKDVC is a 4-bit counter (bit 0-bit 3) with CLK as its input clock. Writes to TBCKDVC are
ignored. TBCKDVC can be read, but the upper 4 bits will read as 1.
After reset (RES signal input, BRK instruction execution, op code trap) TBCKDVC will be F0H.
7
6
5
0
1
2
3
4
TBCKDVR
Reset state
11
1
0
1
— indicates bits that are not provided.
They will be read as 1.
Address : 011FH
R/W access : R/W
TBCKDVR is a 4-bit register (bit 0-bit 3) that stores the reload value to TBCKDVC.
TBCKDVR can be written, but the upper 4 bits will be ignored. TBCKDVR can be read, but the
upper 4 bits will read as 1.
After reset (RES signal input, BRK instruction execution, op code trap) TBCKDVR will be F0H. The
1/n counter will divide CLK by 16, so a 1/16 CLK will be supplied to TBC as TBCCLK.
After a reload value is written to TBCKDVR, it may take up to 16 CLK pulses before the frequency
division by the written value affects operation.
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PDF描述
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MSM6992-AS 32-BIT, 32 MHz, OTHER DSP, CPGA132
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