參數(shù)資料
型號： MSC8122_07
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
元件分類： 數(shù)字信號處理
英文描述： Quad Digital Signal Processor
中文描述： 四路數(shù)字信號處理器
文件頁數(shù)： 26/48頁
文件大小： 793K
代理商： MSC8122_07
MSC8122 Quad Digital Signal Processor Data Sheet, Rev. 14
Electrical Characteristics
Freescale Semiconductor
26
2.5.5.2
CLKIN to CLKOUT Skew
Table 17
describes the
CLKOUT-
to-
CLKIN
skew timing.
For designs that use the
CLKOUT
synchronization mode, use the skew values listed in
Table 16
to adjust the rise-to-fall timing
values specified for
CLKIN
synchronization.
Figure 12
shows the relationship between the
CLKOUT
and
CLKIN
timings.
Table 16. CLKOUT Skew
No.
Characteristic
Min
1
Max
1
Units
20
Rise-to-rise skew
V
DD
= 1.1 V
V
DD
= 1.2 V
Fall-to-fall skew
V
DD
= 1.1 V
V
DD
= 1.2 V
CLKOUT phase (1.2 V, 133 MHz)
Phase high
Phase low
CLKOUT phase (1.1 V, 133 MHz)
Phase high
Phase low
CLKOUT phase (1.1 V, 100 MHz)
Phase high
Phase low
1.
A positive number indicates that CLKOUT precedes CLKIN, A negative number indicates that CLKOUT follows CLKIN.
2.
Skews are measured in clock mode 29, with a CLKIN:CLKOUT ratio of 1:1. The same skew is valid for all clock modes.
3.
CLKOUT skews are measured using a load of 10 pF.
4.
CLKOUT skews and phase are not measured for 500/166 Mhz parts because these parts only use CLKIN mode.
0.0
0.0
0.95
0.85
ns
ns
21
–1.5
–0.8
1.0
1.0
ns
ns
22
2.8
2.8
—
—
ns
ns
23
2.2
2.2
—
—
ns
ns
24
3.3
3.3
—
—
ns
ns
Notes:
Figure 12. CLKOUT and CLKIN Signals.
CLKIN
CLKOUT
20
21
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PDF描述
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