參數(shù)資料
型號(hào)： MPC9448ACR2
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 6/13頁(yè)
文件大?。?/td> 0K
描述： IC CLOCK BUFFER MUX 1:12 32-LQFP
標(biāo)準(zhǔn)包裝： 2,000
類型： 扇出緩沖器（分配），多路復(fù)用器
電路數(shù)： 1
比率 - 輸入:輸出： 1:12
差分 - 輸入:輸出： 是/無(wú)
輸入： LVCMOS，LVPECL
輸出： LVCMOS
頻率 - 最大： 350MHz
電源電壓： 2.375 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-LQFP
供應(yīng)商設(shè)備封裝： 32-TQFP（7x7）
包裝： 帶卷 (TR)
MPC9448 REVISION 7 DECEMBER 21, 2012
2
2012 Integrated Device Technology, Inc.
MPC9448 Data Sheet
3.3V/2.5V LVCMOS 1:12 CLOCK FANOUT BUFFER
Figure 1. Logic Diagram
Figure 2. 32-Lead Pinout (Top View)
SYNC
1
0
CCLK
Stop
CLK
CLK_SEL
OE
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
Q8
Q9
Q11
Q10
PCLK
CLK_STOP
PCLK
VCC
(All input resistors have a value of 25 k
)
Q3
VCC
Q2
GND
Q1
VCC
Q0
GND
Q8
VCC
Q9
GND
Q10
GN
D
Q4
V
CC
Q5
GN
D
Q6
V
CC
Q7
CL
K_SE
L
CCLK
PCL
K
PCL
K
CLK
_ST
OP
OE
V
CC
GN
D
25
26
27
28
29
30
31
32
15
14
13
12
11
10
9
1234
567
8
24
23
22
21
20
19
18
17
16
MPC9448
GND
VCC
Q11
Table 1. Function Table
Control
Default
0
1
CLK_SEL
1
PECL differential input selected
CCLK input selected
OE
1
Outputs disabled (high-impedance state)(1)
1. OE = 0 will high-impedance tristate all outputs independent on CLK_STOP.
Outputs enabled
CLK_STOP
1
Outputs synchronously stopped in logic low state
Outputs active
Table 2. Pin Configurations
Pin
I/O
Type
Function
PCLK, PCLK
Input
LVPECL
Clock signal input
CCLK
Input
LVCMOS
Alternative clock signal input
CLK_SEL
Input
LVCMOS
Clock input select
CLK_STOP
Input
LVCMOS
Clock output enable/disable
OE
Input
LVCMOS
Output enable/disable (high-impedance tristate)
Q0–11
Output
LVCMOS
Clock outputs
GND
Supply
Ground
Negative power supply (GND)
VCC
Supply
VCC
Positive power supply for I/O and core. All VCC pins must be
connected to the positive power supply for correct operation
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