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參數(shù)資料
| 型號： | MPC8555CPXAJD |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 40/88頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU POWERQUICC III 783-FCPBGA |
| 標準包裝： | 36 |
| 系列： | MPC85xx |
| 處理器類型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 533MHz |
| 電壓： | 1.2V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 783-BBGA，F(xiàn)CBGA |
| 供應商設備封裝： | 783-FCPBGA（29x29） |
| 包裝： | 托盤 |
| 配用： | CWH-PPC-8540N-VE-ND - KIT EVAL SYSTEM MPC8540 |
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MPC8555E PowerQUICC III Integrated Communications Processor Hardware Specification, Rev. 4.2
Freescale Semiconductor
45
CPM
Figure 24 through Figure 30 represent the AC timing from Table 33 and Table 34. Note that although the
specifications generally reference the rising edge of the clock, these AC timing diagrams also apply when
the falling edge is the active edge.
Figure 24 shows the FCC internal clock.
Figure 24. FCC Internal AC Timing Clock Diagram
Figure 25 shows the FCC external clock.
Figure 25. FCC External AC Timing Clock Diagram
Figure 26 shows Ethernet collision timing on FCCs.
Figure 26. Ethernet Collision AC Timing Diagram (FCC)
FCC Output Signals
(When GFMR TCI = 1)
tFIKHOX
BRG_OUT
tFIIXKH
tFIIVKH
FCC Input Signals
FCC Output Signals
(When GFMR TCI = 0)
tFIKHOX
FCC Output Signals
(When GFMR TCI = 1)
tFEKHOX
Serial CLKIN
tFEIXKH
tFEIVKH
FCC Input Signals
FCC Output Signals
(When GFMR TCI = 0)
tFEKHOX
COL
(Input)
tFCCH
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