參數(shù)資料
型號： MPC8540CVT667JC
廠商： Freescale Semiconductor
文件頁數(shù)： 10/104頁
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描述： MPU POWERQUICC III 783FCPBGA
標準包裝： 36
系列： MPC85xx
處理器類型： 32-位 MPC85xx PowerQUICC III
速度： 667MHz
電壓： 1.2V
安裝類型： 表面貼裝
封裝/外殼： 784-BBGA，F(xiàn)CBGA
供應商設備封裝： 783-FCPBGA（29x29）
包裝： 托盤
MPC8540 Integrated Processor Hardware Specifications, Rev. 4.1
Freescale Semiconductor
13
Power Characteristics
Table 6 provides estimated I/O power numbers for each block: DDR, PCI, Local Bus, RapidIO, TSEC, and
FEC.
Table 6. Estimated Typical I/O Power Consumption
Interface
Parameter
GVDD (2.5
V)
OVDD (3.3
V)
LVDD (3.3
V)
LVDD (2.5
V)
Units
Notes
DDR I/O
CCB = 200 MHz
0.46
W
1
CCB = 266 MHz
0.59
CCB = 300 MHz
0.66
CCB = 333 MHz
0.73
PCI/PCI-X I/O
32-bit, 33 MHz
0.04
W
2
32-bit 66 MHz
0.07
64-bit, 66 MHz
0.14
64-bit, 133 MHz
0.25
Local Bus I/O
32-bit, 33 MHz
0.07
W
3
32-bit, 66 MHz
0.13
32-bit, 133 MHz
0.24
32-bit, 167 MHz
0.30
RapidIO I/O
500 MHz data rate
0.96
W
4
TSEC I/O
MII
10
mW
5, 6
GMII, TBI (2.5 V)
40
GMII, TBI (3.3 V)
70
RGMII, RTBI
40
FEC I/O
MII
10
mW
7
Notes:
1. GVDD=2.5, ECC enabled, 66% bus utilization, 33% write cycles, 10pF load on data, 10pF load on address/command, 10pF
load on clock
2. OVDD=3.3, 30pF load per pin, 54% bus utilization, 33% write cycles
3. OVDD=3.3, 25pF load per pin, 5pF load on clock, 40% bus utilization, 33% write cycles
4. VDD=1.2, OVDD=3.3
5. LVDD=2.5/3.3, 15pF load per pin, 25% bus utilization
6. Power dissipation for one TSEC only
7. OVDD=3.3, 20pF load per pin, 25% bus utilization
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