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參數(shù)資料
| 型號： | MPC8377CVRANGA |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 95/127頁 |
| 文件大?。?/td> | 0K |
| 描述： | MPU POWERQUICC II 800MHZ 689PBGA |
| 標(biāo)準(zhǔn)包裝： | 27 |
| 系列： | MPC83xx |
| 處理器類型： | 32-位 MPC83xx PowerQUICC II Pro |
| 速度： | 800MHz |
| 電壓： | 1.05V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 689-BBGA 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 689-TEPBGA II（31x31） |
| 包裝： | 托盤 |
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MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 8
Freescale Semiconductor
7
1.12
Enhanced Secured Digital Host Controller (eSDHC)
The enhanced SD host controller (eSDHC) has the following features:
Conforms to SD Host Controller Standard Specification, Rev 2.0 with Test Event register support.
Compatible with the MMC System Specification, Rev 4.0
Compatible with the SD Memory Card Specification, Rev 2.0, and supports High Capacity SD
memory cards
Compatible with the SDIO Card Specification Rev, 1.2
Designed to work with SD Memory, miniSD Memory, SDIO, miniSDIO, SD Combo, MMC,
MMCplus, MMC 4x, and RS-MMC cards
SD bus clock frequency up to 50 MHz
Supports 1-/4-bit SD and SDIO modes, 1-/4-bit MMC modes
Supports internal DMA capabilities
2
Electrical Characteristics
This section provides the AC and DC electrical specifications and thermal characteristics for the chip. The
device is currently targeted to these specifications. Some of these specifications are independent of the I/O
cell, but are included for a more complete reference. These are not purely I/O buffer design specifications.
2.1
Overall DC Electrical Characteristics
This section covers the ratings, conditions, and other characteristics.
2.1.1
Absolute Maximum Ratings
This table provides the absolute maximum ratings.
Table 2. Absolute Maximum Ratings1
Characteristic
Symbol
Max Value
Unit
Note
Core supply voltage
VDD
–0.3 to 1.1
V
—
PLL supply voltage (e300 core, eLBC, and system)
AVDD
–0.3 to 1.1
V
—
DDR1 and DDR2 DRAM I/O voltage
GVDD
–0.3 to 2.75
–0.3 to 1.98
V—
Three-speed Ethernet I/O, MII management voltage
–0.3 to 3.63
V
—
PCI, DUART, system control and power management, I2C, and
JTAG I/O voltage
OVDD
–0.3 to 3.63
V
—
Local bus
LBVDD
–0.3 to 3.63
V
—
SerDes
L[1,2]_
nVDD
–0.3 to 1.1
V
相關(guān)PDF資料 |
PDF描述 |
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