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參數(shù)資料
| 型號： | MPC8315E-RDBA |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 39/106頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD MPU 8315 POWERQUICC II |
| 標(biāo)準包裝： | 1 |
| 系列： | PowerQUICC II™ PRO |
| 類型： | MPU |
| 適用于相關(guān)產(chǎn)品： | MPC8315E |
| 所含物品： | 板 |
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MPC8315E PowerQUICC II Pro Processor Hardware Specifications, Rev. 2
38
Freescale Semiconductor
Ethernet: Three-Speed Ethernet, MII Management
Figure 20. SGMII Receiver Input Compliance Mask
Table 38. SGMII Receive AC Timing Specifications
At recommended operating conditions with XCOREVDD = 1.0V ± 5%.
Parameter
Symbol
Min
Typ
Max
Unit
Note
Deterministic Jitter Tolerance
JD
0.37
—
UI p-p
1
Combined Deterministic and Random Jitter Tolerance
JDR
0.55
—
UI p-p
1
Sinusoidal Jitter Tolerance
JSIN
0.1
—
UI p-p
1
Total Jitter Tolerance
JT
0.65
—
UI p-p
1
Bit Error Ratio
BER
—
10-12
—
Unit Interval
UI
799.92
800
800.08
ps
2
AC Coupling Capacitor
CTX
5—
200
nF
3
Note:
1. Measured at receiver.
2. Each UI is 800 ps ± 100 ppm.
3. The external AC coupling capacitor is required. It’s recommended to be placed near the device transmitter outputs.
4. Refer to RapidIOTM 1x/4x LP Serial Physical Layer Specification for interpretation of jitter specifications.
Time (UI)
R
eceiv
e
rDi
ff
e
rential
Inpu
t
V
ol
tag
e
0
0.275
0.4
0.6
0.725
V
RX_DIFFp-p-min/2
VRX_DIFFp-p-min/2
V
RX_DIFFp-p-max/2
VRX_DIFFp-p-max/2
0
1
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PDF描述 |
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參數(shù)描述 |
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| MPC8315VRADD | 制造商:Freescale Semiconductor 功能描述:MPC8315VRADD - Bulk |
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