參數(shù)資料
型號： MPC564CZP40
廠商： Freescale Semiconductor
文件頁數(shù)： 463/1420頁
文件大小： 0K
描述： IC MPU 32BIT W/CODE COMP 388PBGA
標準包裝： 40
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 40MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 56
程序存儲器容量： 512KB（512K x 8）
程序存儲器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 388-BBGA
包裝： 托盤
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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MPC561/MPC563 Reference Manual, Rev. 1.2
Index-14
Freescale Semiconductor
MIOS14SR0 interrupt status register 17-66
MIOS14SR1 interrupt status register 17-67
MIOS14TPCR test and signal control register 17-14
MIOS14TVECT vector register 17-14
MIOS14VNR module and version number
register 17-14
MISC counter register (MISCNT) 20-6
MISR High register 20-5
MISR Low register 20-5
MMCSM registers 17-22
MMCSMCNT MMCSM up-counter register 17-23
MMCSMML MMCSM modulus latch register 17-24
MMCSMSCR MMCSM status/control register 17-24
MMSCM status/control register duplicated
(MMCSMSCRD) 17-24
module configuration (QADC64E) 13-8
MPIOSMDDR MPIOSM data direction register 17-63
MPIOSMDR MPIOSM data register 17-62
MPWMCNTR MPWMSM counter register 17-58
MPWMPERR MPWMSM period register 17-57
MPWMPULR MPWMSM pulse width register 17-58
MPWMSCR MPWMSM status/control register 17-58
pads module configuration register (PDMCR) 2-22
pads module configuration register 2 (PDMCR2) 2-23
pending interrupt request register (UIPEND) 12-8
periodic interrupt status and control register
(PISCR) 6-44
periodic interrupt timer count register (PITC) 6-45
periodic interrupt timer register (PITR) 6-45
PLL, low power, and reset control register
(PLPRCR) 8-33
port A data register (PORTQA) 13-13
port B data register (PORTQB) 13-13
processor version register (PVR) 3-25
QACR0 control register 13-15, 14-14
QADC64E control register 1 (QACR1) 13-15, 14-16
QADC64E control register 2 (QACR2) 13-17, 13-18,
QADC64E module configuration (QADCMCR) 14-8
QADC64E PORTQA Port A data register 14-13
QADC64E PORTQA port A data register 13-13
READI data trace attribute 1 register (DTA1) 24-17
READI data trace attribute 2 register (DTA2) 24-17
READI development control register (DC) 24-10
READI device ID register (DID) 24-9
READI mode control register (MC) 24-11
READI ownership trace register (OTR) 24-8
READI read/write access register (RWA) 24-13
READI upload/download information register
(UDI) 24-15
READI user base address register (UBA) 24-12
real-time clock alarm register (RTCAL) 6-44
real-time clock register (RTC) 6-43
real-time clock status and control register (RTCSC) 6-42
receive mask 16-7
reset status register (RSR) 7-5
SGPIO control register (SGPIOCR) 6-48
SGPIO data register 1 (SGPIODT1) 6-46
SGPIO data register 2 (SGPIODT2) 6-47
SIU interrupt edge level register (SIEL) 6-35
SIU interrupt mask registers (SIMASK) 6-33
SIU interrupt vector register (SIVEC) 6-35
SIU module configuration register (SIUMCR) 6-25
software service register (SWSR) 6-38
special purpose 3-44
added registers, 3-44
unsupported registers, 3-44
status (QASR) 13-20, 14-22
status (QASR0) 13-21, 14-22
status (QASR1) 13-27, 14-28
system clock and reset control register (SCCR) 8-30
system protection control register (SYPCR) 6-37
time base control and status register (TBSCR) 6-42
time base reference registers (TBREF0 and
TBREF1) 6-41
time base SPR (TB) 3-23
time base SPR (TBSPR) 6-40
TOUCAN control register (CANCTRL0) 16-27
TOUCAN control register 0 (CANCTRL0) 16-27
TOUCAN control register 1 (CANCTRL1) 16-28
TOUCAN control register 2 (CANCTRL2) 16-30
TOUCAN error and status register (ESTAT) 16-33
TOUCAN error counters 16-36
TOUCAN free running timer (TIMER) 16-31
TOUCAN interrupt configuration register
(CANICR) 16-27
TOUCAN interrupt flag register (IFLAG) 16-36
TOUCAN interrupt mask register (IMASK) 16-35
TOUCAN module configuration register
(CANMCR) 16-25
TOUCAN prescaler divide register (PRESDIV) 16-29
TOUCAN receive buffer 14 mask registers 16-32
TOUCAN receive buffer 15 mask registers 16-33
TOUCAN receive global mask registers 16-31
TPU channel interrupt enable register (CIER) 19-15
TPU channel interrupt status register (CISR) 19-19
TPU channel priority register (CPR) 19-18
TPU development support control register
(DSCR) 19-12
TPU function select register (CFSR) 19-15
TPU host sequence register (HSQR) 19-16
TPU host service request register (HSRR) 19-17
TPU interrupt configuration register (TICR) 19-14
TPU module configuration register (TPUMCR) 19-11
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