Codec Mode (8-,16-, 24-, and 32-bit)/I
參數(shù)資料
型號： MPC5200VR400B
廠商： Freescale Semiconductor
文件頁數(shù)： 42/72頁
文件大?。?/td> 0K
描述： IC MPU PROCESSOR 32BIT 272-PBGA
標準包裝： 40
系列： MPC52xx
核心處理器： e300
芯體尺寸： 32-位
速度： 400MHz
連通性： CAN，EBI/EMI，以太網(wǎng)，I²C，IrDA，J1850，SPI，UART/USART，USB
外圍設(shè)備： AC'97，DMA，I²S，POR，PWM，WDT
輸入/輸出數(shù)： 56
程序存儲器類型： 外部程序存儲器
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 1.42 V ~ 1.58 V
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 70°C
封裝/外殼： 272-BBGA
包裝： 托盤
MPC5200B Data Sheet, Rev. 4
Freescale Semiconductor
47
1.3.16
PSC
1.3.16.1
Codec Mode (8-,16-, 24-, and 32-bit)/I2S Mode
NOTE
Output timing is specified at a nominal 50 pF load.
Figure 37. Timing Diagram — 8-, 16-, 24-, and 32-bit CODEC / I2S Master Mode
Table 42. Timing Specifications—8-, 16-, 24-, and 32-bit CODEC / I2S Master Mode
Sym
Description
Min
Typ
Max
Units
SpecID
1
Bit Clock cycle time, programmed in CCS register
40.0
—
ns
A15.1
2
Clock duty cycle
—
50
—
%(1)
1 Bit Clock cycle time.
A15.2
3
Bit Clock fall time
—
7.9
ns
A15.3
4
Bit Clock rise time
—
7.9
ns
A15.4
5
FrameSync valid after clock edge
—
8.4
ns
A15.5
6
FrameSync invalid after clock edge
—
8.4
ns
A15.6
7
Output Data valid after clock edge
—
9.3
ns
A15.7
8
Input Data setup time
6.0
—
ns
A15.8
BitClk
5
3
4
3
4
(CLKPOL=0)
BitClk
(CLKPOL=1)
FrameSync
(SyncPol = 1)
TxD
Output
6
7
8
Output
FrameSync
(SyncPol = 0)
Output
RxD
Input
1
22
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PDF描述
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參數(shù)描述
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MPC52101J 功能描述:厚膜電阻器 - 透孔 MPC5 100R 5% RoHS:否 制造商:Caddock 電阻:27 kOhms 容差:1 % 功率額定值:8 W 溫度系數(shù):50 PPM / C 系列:MS 端接類型:Axial 電壓額定值:2 kV 工作溫度范圍:- 15 C to + 275 C 尺寸:8.89 mm Dia. x 23.11 mm L 封裝:Bulk
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