參數資料
型號： MK20DN512ZVLK10
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PQFP64
封裝： 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, PLASTIC, LQFP-64
文件頁數： 57/84頁
文件大?。?/td> 3949K
代理商： MK20DN512ZVLK10
MB95410H/470H Series
60
DS702-00004-1v0-E
(6) UART/SIO, Serial I/O Timing
(VCC = 5.0 V
±10%, AVSS = VSS = 0.0 V, TA = 40°C to +85°C)
Parameter
Symbol
Pin name
Condition
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
UCK0, UCK1, UCK2
Internal clock
operation output pin:
CL = 80 pF
+ 1 TTL
4 tMCLK*—
ns
UCK
↓→ UO time
tSLOVI
UCK0, UCK1, UCK2,
UO0, UO1, UO2
190
+190
ns
Valid UI
→ UCK ↑
tIVSHI
UCK0, UCK1, UCK2,
UI0, UI1, UI2
2 tMCLK*—
ns
UCK
↑→ valid UI hold time
tSHIXI
UCK0, UCK1, UCK2,
UI0, UI1, UI2
2 tMCLK*—
ns
Serial clock “H” pulse width
tSHSL
UCK0, UCK1, UCK2
External clock
operation output pin:
CL = 80 pF
+ 1 TTL
4 tMCLK*—
ns
Serial clock “L” pulse width
tSLSH
UCK0, UCK1, UCK2
4 tMCLK*—
ns
UCK
↓→ UO time
tSLOVE
UCK0, UCK1, UCK2,
UO0, UO1, UO2
—190
ns
Valid UI
→ UCK ↑
tIVSHE
UCK0, UCK1, UCK2,
UI0, UI1, UI2
2 tMCLK*—
ns
UCK
↑→ valid UI hold time
tSHIXE
UCK0, UCK1, UCK2,
UI0, UI1, UI2
2 tMCLK*—
ns
0.8 V0.8 V
2.4 V
tSLOVI
tIVSHI
tSHIXI
2.4 V
0.8 V
UCK0,
UCK1,
UCK2
UO0,
UO1,
UO2
UI0,
UI1,
UI2
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
tSCYC
Internal shift clock mode
0.2 VCC
0.8 VCC
tSLOVE
tIVSHE
tSHIXE
2.4 V
0.8 V
UCK0,
UCK1,
UCK2
UO0,
UO1,
UO2
UI0,
UI1,
UI2
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
tSLSH
tSHSL
External shift clock mode
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