參數(shù)資料
型號(hào): MK1575-01GILF
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 3/14頁(yè)
文件大小: 0K
描述: IC CLK RECOVERY PLL 16-TSSOP
標(biāo)準(zhǔn)包裝: 96
類型: 時(shí)鐘和數(shù)據(jù)恢復(fù)(CDR),多路復(fù)用器
PLL:
主要目的: 視頻
輸入: 時(shí)鐘
輸出: LVCMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 無(wú)/無(wú)
頻率 - 最大: 80MHz
電源電壓: 3.15 V ~ 3.45 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 管件
其它名稱: 800-2630-5
MK1575-01GILF-ND
MK1575-01
CLOCK RECOVERY PLL
CLOCK SYNTHESIZER
IDT CLOCK RECOVERY PLL
11
MK1575-01
REV P 051310
AC Electrical Characteristics
Unless stated otherwise, VDD = 3.3V ±5%, Ambient Temperature -40 to +85
° C
Output High Voltage
VOH
IOH = -8 mA
CLK1, CLK2
2.0
V
IOH = -4 mA
FCLK
2.0
V
Output Low Voltage
VOL
IOL = 8 mA
CLK1, CLK2
0.4
V
IOL = 4 mA
FCLK
0.4
V
Short Circuit Current
IOS
CLK1, CLK2
±43
mA
FCLK
±18
mA
Nominal Output Impedance
ZOUT
20
Ω
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Clock Frequency
(into pins REFIN or FBIN)
fREF
20
MHz
Internal VCO Frequency
fVCO
96
320
MHz
Output Frequency
fCLK
80
MHz
Output Rise Time
tOR
0.8 to 2.0 V
.6
1.1
ns
Output Fall Time
tOF
2.0 to 0.8 V
.6
1.1
ns
Output Clock Duty Cycle
tDC
At VDD/2
45
50
55
%
Jitter, Absolute Peak-to-peak
tJ
Single cycle
measurement;
Deviation from mean
150
ps
Long Term Timing Jitter, pk-pk
tJLT
10
μS trigger delay
1.7
3.0
ns
VCO Gain
KO
340
MHz/V
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
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