參數(shù)資料
型號: MD80C52XXX-20SC
廠商: TEMIC SEMICONDUCTORS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40
文件頁數(shù): 357/604頁
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代理商: MD80C52XXX-20SC
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42073A-MCU Wireless-02/13
ATmega2564/1284/644RFR2
A reset forces the radio transceiver into the TRX_OFF state.
A reset is initiated by a ATmega2564/1284/644RFR2 main reset (see "Resetting the
AVR" on page 207) or a radio transceiver reset (see "Transceiver Pin Register TRXPR"
During radio transceiver reset the TRXPR register is not cleared and therefore the
application software has to set the SLPTR bit to “0”.
9.4.1.3 Interrupt Handling
All interrupts provided by the radio transceiver are supported in Basic Operating Mode
Required interrupts must be enabled by writing to register IRQ_MASK and the global
interrupt enable flag must be set. For a general explanation of the interrupt handling
For example, interrupts are provided to observe the status of the RX and TX operations.
On receive the TRX24_RX_START interrupt indicates the detection of a valid PHR, the
TRX24_XAH_AMI interrupt an address match and the TRX24_RX_END interrupt the
completion of the frame reception.
On transmit the TRX24_TX_END interrupt indicates the completion of the frame
transmission.
Figure 9-14 on page 43 shows an example for a transmit/receive transaction between
two devices and the related interrupt events in Basic Operating Mode. Device 1
transmits a frame containing a MAC header (in this example of length 7), payload and
valid FCS. The frame is received by Device 2 which generates the interrupts during the
processing of the incoming frame. The received frame is stored in the Frame Buffer.
If the received frame passes the address filter (refer to section "Frame Filtering" on
page 58) an address match TRX24_XAH_AMI interrupt is issued after the reception of
the MAC header (MHR).
In Basic Operating Mode the TRX24_RX_END interrupt is issued at the end of the
received frame. In Extended Operating Mode (refer to "Extended Operating Mode" on
page 47) the interrupt is only issued if the received frame passes the address filter and
the FCS is valid. Further exceptions are explained in "Extended Operating Mode" on
Processing delay tIRQ is a typical value (see chapter "Digital Interface Timing
相關PDF資料
PDF描述
MQ80C52TXXX-20/883D 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQFP44
MC80C52CXXX-25/883D 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CDIP40
MC80C52XXX-25P883D 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CDIP40
MR80C52EXXX-25SCD 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQCC44
MQ80C32-25SBD 8-BIT, 25 MHz, MICROCONTROLLER, CQFP44
相關代理商/技術參數(shù)
參數(shù)描述
MD80C86 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor
MD80C862 制造商:Intel 功能描述:PROCESSOR:MICRO-PROCESSOR
MD80C86-2 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor
MD80C86-2/883 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube 制造商:Rochester Electronics LLC 功能描述:CPU 16BILT 5V CMOS 8MHZ 40CDIP - Bulk
MD80C86-2/B 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube