參數(shù)資料
型號： MCIMX515DVK8C
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： SPECIALTY MICROPROCESSOR CIRCUIT, PBGA625
封裝： 13 X 13 MM, 0.50 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-625
文件頁數(shù)： 151/198頁
文件大小： 3041K
代理商： MCIMX515DVK8C
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i.MX51 Applications Processors for Consumer and Industrial Products, Rev. 4
56
Freescale Semiconductor
Electrical Characteristics
WE5
Clock rise to address
invalid
0.5t-1.25
—
t-1.25
t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE6
Clock rise to CSx_B valid
-0.5t-1.25
-0.5t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
WE7
Clock rise to CSx_B
invalid
0.5t-1.25
0.5t+1.75
2t-1.25
2t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE8
Clock rise to WE_B Valid
-0.5t-1.25
-0.5t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
WE9
Clock rise to WE_B
Invalid
0.5t-1.25
0.5t+1.75
2t-1.25
2t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE10
Clock rise to OE_B Valid
-0.5t-1.25
-0.5t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
WE11
Clock rise to OE_B
Invalid
0.5t-1.25
0.5t+1.75
2t-1.25
2t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE12
Clock rise to BEy_B Valid
-0.5t-1.25
-0.5t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
WE13
Clock rise to BEy_B
Invalid
0.5t-1.25
0.5t+1.75
t-1.25
t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE14
Clock rise to ADV_B
Valid
-0.5t-1.25
-0.5t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
WE15
Clock rise to ADV_B
Invalid
0.5t-1.25
0.5t+1.75
t-1.25
t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE164 Clock rise to Output Data
Valid
-0.5t-1.25
-0.5t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
-t-1.25
-t+1.75
WE174 Clock rise to Output Data
Invalid
0.5t-1.25
0.5t+1.75
t-1.25
t+1.75
2t-1.25
2t+1.75
3t-1.25
3t+1.75
WE184 Input Data setup time to
Clock rise
2
—
4
—
———
—
WE194 Input Data hold time from
Clock rise
2
—
2
—
———
—
WE20
WAIT_B setup time to
Clock rise
2
—
4
—
———
—
WE21
WAIT_B hold time from
Clock rise
2
—
2
—
———
—
1 t is axi_clk cycle time. The maximum allowed axi_clk frequency is 133 MHz, whereas the maximum allowed BCLK frequency
is 104 MHz. As a result if BCD = 0, axi_clk must be
≤104 MHz. If BCD = 1, then 133 MHz is allowed for axi_clk, resulting in a
BCLK of 66.5 MHz. When the clock branch to WEIM is decreased to 104 MHz, other busses are impacted which are clocked
from this source. See the CCM chapter of the i.MX51 Multimedia Applications Processor Reference Manual (MCIMX51RM)
for a detailed clock tree description.
2 BCLK parameters are being measured from the 50% point that is, high is defined as 50% of signal value and low is defined
as 50% as signal value.
3 For signal measurements “High” is defined as 80% of signal value and “Low” is defined as 20% of signal value.
4 The lower 16 bits of the WEIM bus are limited to 90 MHz.”
Table 53. WEIM Bus Timing Parameters (continued)1
ID
Parameter
BCD = 0
BCD = 1
BCD = 2
BCD = 3
Min
Max
Min
Max
Min
Max
Min
Max
相關PDF資料
PDF描述
MCIMX535DVV1B SPECIALTY MICROPROCESSOR CIRCUIT, PBGA529
MCL908QY1DWE 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16
MCL908QY1CDWE 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16
MCL908QT4CPE 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP8
MCL908QY2CDTE 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16
相關代理商/技術參數(shù)
參數(shù)描述
MCIMX515DVM8B 制造商:Freescale Semiconductor 功能描述:APPLICATIONS PROCESSOR TRAY - Bulk
MCIMX516AJM6C 功能描述:處理器 - 專門應用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風格:SMD/SMT 封裝 / 箱體:MAPBGA-432
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MCIMX518DVK8C 制造商:Freescale Semiconductor 功能描述:ELVIS 3.0 - Bulk
MCIMX51EVK 制造商:Freescale Semiconductor 功能描述:
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