參數(shù)資料
型號(hào)： MCIMX257CJM4
廠商： Freescale Semiconductor
文件頁數(shù)： 107/153頁
文件大?。?/td> 0K
描述： MPU IMX25 IND 400-MAPBGA
特色產(chǎn)品： MCIMX25 Applications Processors
標(biāo)準(zhǔn)包裝： 90
系列： i.MX25
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲(chǔ)器類型： 外部程序存儲(chǔ)器
RAM 容量： 144K x 8
電壓 - 電源 (Vcc/Vdd)： 1.15 V ~ 1.52 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 3x12b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 400-LFBGA
包裝： 托盤
i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
Freescale Semiconductor
57
Figure 26. SDR SDRAM Write Cycle Timing Diagram
SD6
Address setup time
tAS
2.0
—
ns
SD7
Address hold time
tAH
1.8
—
ns
SD8
SDRAM access time
tAC
—
6.47
ns
SD9
Data out hold time2
tOH
1.2
—
ns
SD10
Active to read/write command period
tRC
10
—
clock
1 SD1 + SD2 does not exceed 7.5 ns for 133 MHz.
2 Timing parameters are relevant only to SDR SDRAM. For the specific DDR SDRAM data related timing parameters, see
Table 44. DDR/SDR SDRAM Read Cycle Timing Parameters (continued)
ID
Parameter
Symbol
Min.
Max.
Unit
CS
CAS
WE
RAS
ADDR
DQ
DQM
BA
ROW / BA
COL/BA
DATA
SD4
SD5
SD7
SD6
SD12
SD13
SD14
SD11
SDCLK
SD1
SD3
SD2
SDCLK
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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