參數(shù)資料
型號： MCF5307FT90BB1
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 90 MHz, RISC PROCESSOR, PQFP208
封裝： 28 X 28 MM, 3.30 MM HEIGHT, 0.50 MM PITCH, PLASTIC, QFP-208
文件頁數(shù)： 84/502頁
文件大?。?/td> 4488K
代理商： MCF5307FT90BB1
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5-46
MCF5307 User’s Manual
Processor Status, DDATA Denition
Exception Processing
PST = 0xC, {PST = 0xB, DD = destination},// stack frame
{PST = 0xB, DD = destination},// stack frame
{PST = 0xB, DD = source},// vector read
PST = 0x5, {PST = [0x9AB], DD = target}// PC of handler
The PST/DDATA specication for the reset exception is shown below:
Exception Processing PST = 0xC,
PST = 0x5,{PST = [0x9AB], DD = target}//
PC of handler
The initial references at address 0 and 4 are never captured nor displayed since these
accesses are treated as instruction fetches.
For all types of exception processing, the PST = 0xC value is driven at all times, unless the
PST output is needed for one of the optional marker values or for the taken branch indicator
(0x5).
5.8.2 Supervisor Instruction Set
The supervisor instruction set has complete access to the user mode instructions plus the
opcodes shown below. The PST/DDATA specication for these opcodes is shown in
unlk
Ax
PST = 0x1, {PST = 0xB, DD = destination operand}
wddata.b
<ea>y
PST = 0x4, {PST = 0x8, DD = source operand
wddata.l
<ea>y
PST = 0x4, {PST = 0xB, DD = source operand
wddata.w
<ea>y
PST = 0x4, {PST = 0x9, DD = source operand
1
For JMP and JSR instructions, the optional target instruction address is displayed only for those effective
address elds dening variant addressing modes. This includes the following <ea>x values: (An), (d16,An),
(d8,An,Xi), (d8,PC,Xi).
2
For Move Multiple instructions (MOVEM), the processor automatically generates line-sized transfers if the
operand address reaches a 0-modulo-16 boundary and there are four or more registers to be transferred. For
these line-sized transfers, the operand data is never captured nor displayed, regardless of the CSR value.
The automatic line-sized burst transfers are provided to maximize performance during these sequential
memory access operations.
3
During normal exception processing, the PST output is driven to a 0xC indicating the exception processing
state. The exception stack write operands, as well as the vector read and target address of the exception
handler may also be displayed.
Table 5-23. PST/DDATA Specification for Supervisor-Mode Instructions
Instruction
Operand Syntax
PSTDDATA
cpushl
PST = 0x1
halt
PST = 0x1,
PST = 0xF
move.w
SR,Dx
PST = 0x1
move.w
{Dy,#imm},SR
PST = 0x1, {PST = 3}
Table 5-22. PST/DDATA Specification for User-Mode Instructions (Continued)
Instruction
Operand Syntax
PST/DDATA
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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MCF5307FT90B 32-BIT, 90 MHz, RISC PROCESSOR, PQFP208
MCF5328CVM240 32-BIT, 240 MHz, RISC PROCESSOR, PBGA256
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