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參數(shù)資料
| 型號： | MCF5206CAB16A |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 343/449頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU COLDFIRE 16MHZ 160-QFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | MCF520x |
| 核心處理器： | Coldfire V2 |
| 芯體尺寸： | 32-位 |
| 速度： | 16MHz |
| 連通性： | I²C，UART/USART |
| 外圍設(shè)備： | POR，WDT |
| 輸入/輸出數(shù)： | 8 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 512 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.75 V ~ 5.25 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 160-BQFP |
| 包裝： | 托盤 |
| 配用： | M5206EC3-ND - KIT EVAL FOR MCF5206E W/ETHERNET |
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IEEE 1149.1 Test Access Port (JTAG)
15-4
MCF5206 USERS MANUAL Rev 1.0
MOTOROLA
also configure the direction of bidirectional pins and establish high-impedance states on
some pins. The EXTEST instruction becomes active on the falling edge of TCK in the
update-IR state when the data held in the instruction-shift register is equivalent to octal 0.
15.3.1.2 IDCODE. The IDCODE instruction selects the 32-bit IDcode register for
connection as a shift path between the TDI pin and the TDO pin. This instruction lets you
interrogate the MCF5206 to determine its version number and other part identification
data. The IDcode register has been implemented in accordance with IEEE 1149.1 so that
the least significant bit of the shift register stage is set to logic 1 on the rising edge of TCK
following entry into the capture-DR state. Therefore, the first bit to be shifted out after
selecting the IDcode register is always a logic 1. The remaining 31-bits are also set to
fixed values (see 15.3.2 IDcode Register) on the rising edge of TCK following entry into
the capture-DR state.
The IDCODE instruction is the default value placed in the instruction register when a
JTAG reset is accomplished by either asserting TRST or holding TMS high while clocking
TCK through at least five rising edges and the falling edge after the fifth rising edge. A
JTAG reset causes the TAP state machine to enter the test-logic-reset state (normal
operation of the TAP state machine into the test-logic-reset state also results in placing
the default value of octal 1 into the instruction register). The shift register portion of the
instruction register is loaded with the default value of octal 1 when in the Capture-IR state
and a rising edge of TCK occurs.
15.3.1.3 SAMPLE/PRELOAD INSTRUCTION. The SAMPLE/PRELOAD instruction
provides two separate functions. First, it obtains a sample of the system data and control
signals present at the MCF5206 input pins and just prior to the boundary scan cell at the
output pins. This sampling occurs on the rising edge of TCK in the capture-DR state when
an instruction encoding of octal 4 is resident in the instruction register. You can observe
this sampled data by shifting it through the boundary-scan register to the output TDO by
using the shift-DR state. Both the data capture and the shift operation are transparent to
system operation. You are responsible for providing some form of external
synchronization to achieve meaningful results because there is no internal
synchronization between TCK and the system clock, CLK.
The second function of the SAMPLE/PRELOAD instruction is to initialize the boundary
scan register update cells before selecting EXTEST or CLAMP. This is achieved by
ignoring the data being shifted out of the TDO pin while shifting in initialization data. The
update-DR state in conjunction with the falling edge of TCK can then transfer this data to
the update cells. This data is applied to the external output pins when one of the
instructions listed above is applied.
15.3.1.4 HIGHZ INSTRUCTION. The HIGHZ instruction anticipates the need to
backdrive the output pins and protect the input pins from random toggling during circuit
board testing. The HIGHZ instruction selects the bypass register, forcing all output and
bidirectional pins to the high-impedance state.
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VE-B6V-CU-B1 | CONVERTER MOD DC/DC 5.8V 200W |
| VJ2225A223JBBAT4X | CAP CER 0.022UF 100V 5% NP0 2225 |
| MC912D60AMPVE8 | IC MCU 16BIT 8MHZ 112-LQFP |
| VJ2225A223JBCAT4X | CAP CER 0.022UF 200V 5% NP0 2225 |
| VE-B6T-IY-F4 | CONVERTER MOD DC/DC 6.5V 50W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MCF5206CAB25A | 功能描述:微處理器 - MPU MCF5206 V2CORE 512SRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5206CFT16A | 制造商:Rochester Electronics LLC 功能描述:MCF5206 V2CORE 512SRAM - Bulk |
| MCF5206CFT25A | 制造商:Rochester Electronics LLC 功能描述:MCF5206 V2CORE 512SRAM - Bulk |
| MCF5206E | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:CodeWarrior Development Studio for ColdFire㈢ Architectures |
| MCF5206EAB40 | 功能描述:微處理器 - MPU MCF5206E V2CORE 8KSRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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