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參數資料
| 型號： | MC9328MX21VM |
| 廠商： | Motorola, Inc. |
| 英文描述： | i.MX family of microprocessors |
| 中文描述： | i.MX系列微處理器 |
| 文件頁數： | 25/96頁 |
| 文件大?。?/td> | 1495K |
| 代理商： | MC9328MX21VM |
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Specifications
MC9328MX1 Advance Information, Rev. 4
Freescale Semiconductor
25
3.9.2.2 DTACK Read Cycle DMA Enabled
Figure 7. DTACK Read Cycle DMA Enabled
5
DTACK
asserted to OE negated
3T+2.2
4T+6.86
ns
6
Data hold timing after OE negated
0
–
ns
7
Data ready after DTACK
asserted
0
T
ns
8
OE negated to CS negated
0.5T+0.24
0.5T+0.67
ns
9
OE negated after EB negated
0.5
1.5
ns
10
DTACK
pulse width
1T
3T
ns
Note
:
0. DTACK assert means DTACK become low level.
1. T is the system clock period. (For 96MHz system clock)
2. OE and EB assertion time is programmable by OEA bit in CS5L register. EB
assertion in read cycle will occur
only when EBC bit in CS5L register is clear.
3. Address becomes valid and CS asserts at the start of read access cycle.
4. The external DTACK input requirement is eliminated when CS5 is programmed to use internal wait state.
Table 14. Parameters for Read Cycle, WSC = 111111, DTACK_SEL=0, HKCL=96MHz (Continued)
Number
Characteristic
(3.0 ± 0.3) V
Unit
Minimum
Maximum
RW
DTACK
Address
EB
CS5
OE
(logic high)
Databus
input to MX1)
programmable
min 0ns
(1)
(6)
(7)
(3)
(4)
(2)
(5)
(8)
(9)
(10)
(11)
相關PDF資料 |
PDF描述 |
|---|---|
| MC33886DH | 5.0 A H BRIDGE |
| MC33886DHR2 | 5.0 A H BRIDGE |
| MC33886VW | 5.0 A H BRIDGE |
| MC33886VWR2 | 5.0 A H BRIDGE |
| MC33288 | Solid State Relay for Automotive Flasher Applications |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC9328MX21VM | 制造商:Freescale Semiconductor 功能描述:Microprocessor |
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| MC9328MXL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MX Family of applications processors |
| MC9328MXL/D | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:i.MX Integrated Portable System Processor |
| MC9328MXL_06 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MX Family of applications processors |
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