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參數(shù)資料
| 型號： | MC88916 |
| 廠商： | Motorola, Inc. |
| 英文描述： | LOW SKEW CMOS PLL CLOCK DRIVER WITH PROCESSOR RESET |
| 中文描述： | 低偏移的CMOS PLL時鐘驅動器，帶有處理器復位 |
| 文件頁數(shù)： | 4/9頁 |
| 文件大小： | 114K |
| 代理商： | MC88916 |
MC88916
MOTOROLA
TIMING SOLUTIONS
BR1333 — REV 5
4
Figure 1. MC88916 Logic Block Diagram
Q
Q
R
D
Q1
Q
Q
R
D
Q2
Q
Q
R
D
Q3
Q
Q
R
D
Q/2
Q
Q
R
D
Q0
VCO
CH
PUMP
PFD
SYNC
PLL_EN
MR
POWER–ON
RESET
0
1
LOCK INDICATOR AND
RESET_OUT 1024 CYCLE
COUNT CIRCUITRY
RST_IN
2X_Q
RST_OUT
SYNC INPUT TIMING REQUIREMENTS
Symbol
Parameter
Minimum
Maximum
Unit
tRISE/FALL
SYNC Input
Rise/Fall Time, SYNC Input
From 0.8V to 2.0V
—
5.0
ns
tCYCLE,
Input Clock Period
‘DW70
‘DW80
SYNC Input
SYNC Input
57
50
200
ns
Duty Cycle
Duty Cycle, SYNC Input
50%
±
25%
FREQUENCY SPECIFICATIONS
(TA = –40
°
C to +85
°
C; VCC = 5.0V
±
5%)
Guaranteed Minimum
Symbol
Parameter
MC88916DW70
MC88916DW80
Unit
Fmax (2X_Q)
Maximum Operating Frequency, 2X_Q Output
70
80
MHz
Fmax (‘Q’)
Maximum Operating Frequency, Q0–Q2, Q3 Outputs
35
40
MHz
1. Maximum Operating Frequency is guaranteed with the 88916 in a phase–locked condition, and all outputs loaded at 50
terminated to VCC/2.
相關PDF資料 |
PDF描述 |
|---|---|
| MC88916DW | LOW SKEW CMOS PLL CLOCK DRIVER WITH PROCESSOR RESET |
| MC88920 | LOW SKEW CMOS PLL CLOCK DRIVER With Power-Down/ Power-Up Feature |
| MC88920DW | LOW SKEW CMOS PLL CLOCK DRIVER With Power-Down/ Power-Up Feature |
| MC88921DW | LOW SKEW CMOS PLL CLOCK DRIVER With Power-Down/ Power-Up Feature |
| MC88921 | LOW SKEW CMOS PLL CLOCK DRIVER With Power-Down/ Power-Up Feature |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| MC88916DW80 | 功能描述:IC DRIVER CLK PLL 80MHZ 20-SOIC RoHS:否 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標準包裝:1,500 系列:- 類型:時鐘緩沖器/驅動器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應商設備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT |
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