DICC Additional Quiescent Supply Current V
參數(shù)資料
型號： MC74HCT373AFELG
廠商： ON Semiconductor
文件頁數(shù)： 4/9頁
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描述： IC LATCH TRANSP OCT 3ST 20SOEIAJ
標(biāo)準(zhǔn)包裝： 2,000
系列： 74HCT
邏輯類型： D 型透明鎖存器
電路： 8:8
輸出類型： 三態(tài)
電源電壓： 4.5 V ~ 5.5 V
獨(dú)立電路： 1
延遲時(shí)間 - 傳輸： 28ns
輸出電流高，低： 6mA，6mA
工作溫度： -55°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 20-SOIC（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： SOEIAJ-20
包裝： 帶卷 (TR)
MC74HCT373A
http://onsemi.com
4
DICC
Additional Quiescent Supply
Current
Vin = 2.4 V, Any One Input
Vin = VCC or GND, Other Inputs
lout = 0 mA
5.5
≥ 55°C
25°C to 125°C
mA
2.9
2.4
NOTE: 1. Total Supply Current = ICC + SDICC.
AC ELECTRICAL CHARACTERISTICS (VCC = 5.0 V ± 10%, CL = 50 pF, Input tr = tf = 6.0 ns)
Symbol
Parameter
Guaranteed Limit
Unit
– 55 to
25°C
v 85°C
v 125°C
tPLH,
tPHL
Maximum Propagation Delay, Input D to Q
(Figures 1 and 5)
28
35
42
ns
tPLH,
tPHL
Maximum Propagation Delay, Latch Enable to Q
(Figures 2 and 5)
32
40
48
ns
tPLZ,
tPHZ
Maximum Propagation Delay, Output Enable to Q
(Figures 3 and 6)
30
38
45
ns
tPZL,
tPZH
Maximum Propagation Delay, Output Enable to Q
(Figures 3 and 6)
35
44
53
ns
tTLH,
tTHL
Maximum Output Transition Time, Any Output
(Figures 1 and 5)
12
15
18
ns
Cin
Maximum Input Capacitance
10
10
10
pF
Cout
Maximum ThreeState Output Capacitance
(Output in HighImpedance State)
15
15
15
pF
CPD
Power Dissipation Capacitance (Per Latch)*
Typical @ 25°C, VCC = 5.0 V
pF
65
* Used to determine the noload dynamic power consumption: PD = CPD VCC2f + ICC VCC.
TIMING REQUIREMENTS (VCC = 5.0 V ± 10%, Input tr = tf = 6.0 ns)
Symbol
Parameter
Guaranteed Limit
Unit
– 55 to
25°C
v 85°C
v 125°C
tsu
Minimum Setup Time, Input D to Latch Enable
(Figure 4)
10
13
15
ns
th
Minimum Hold Time, Latch Enable to Input D
(Figure 4)
10
13
15
ns
tw
Minimum Pulse Width, Latch Enable
(Figure 2)
12
15
18
ns
tr, tf
Maximum Input Rise and Fall Times
(Figure 1)
500
500
500
ns
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PDF描述
MC74HCT374AN IC FLIP FLOP OCT D 3ST 20-DIP
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參數(shù)描述
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