參數(shù)資料
型號(hào)： MC68HC705L16
廠商： 飛思卡爾半導(dǎo)體(中國(guó))有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 95/146頁
文件大?。?/td> 772K
代理商： MC68HC705L16
MC68HC05L16 MC68HC705L16 Data Sheet, Rev. 4.1
Freescale Semiconductor
95
Chapter 10
LCD Driver
10.1 Introduction
The liquid crystal display (LCD) driver may be configured with four backplanes (BP) and 39 frontplanes
(FP) maximum. The V
DD
voltage is the highest level of the output waveform and the lower three levels
are applied from VLCD1, VLCD2, and VLCD3 inputs.
On reset, LCD enable bit (LCDE) in the LCD control register (LCDCR) is cleared (LCD drivers at a
disabled state) and all BP pins and FP pins output V
DD
levels.
The LCD clock is generated by the timebase module, and the LCLK bit in the TBCR1 selects the clock
frequency.
10.2 LCD Waveform Examples
Figure 10-1
,
Figure 10-2
,
Figure 10-3
, and
Figure 10-4
illustrate the LCD timing examples.
Figure 10-1. LCD 1/1 Duty and 1/1 Bias Timing Diagram
1FRAME
DUTY = 1/1 (STATIC)
BIAS = 1/1 (VLCD1 = V
DD
, VLCD2 = VLCD3 = V
DD
–VLCD)
BP0
FPx
(XXX1)
FPy
(XXX1)
BP0–FPx
(OFF)
BP0–FPy
(ON)
V
DD
, VLCD1
VLCD2, 3
V
DD
, VLCD1
VLCD2, 3
V
DD
, VLCD1
VLCD2, 3
+VLCD
0
–VLCD
+VLCD
0
–VLCD
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PDF描述
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