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參數(shù)資料
| 型號(hào)： | MC68HC08JB1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)(低成本、高性能M68HC08系列的8位微控制器(MCUs)) |
| 中文描述： | 低成本，高性能M68HC08系列系列的8位微控制器單元（MCU）（低成本，高性能M68HC08系列系列的8位微控制器（MCU）的） |
| 文件頁(yè)數(shù)： | 207/214頁(yè) |
| 文件大?。?/td> | 2186K |
| 代理商： | MC68HC08JB1 |
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Electrical Specifications
Control Timing
MC68HC08JB1
—
Rev. 1.0
Technical Data
MOTOROLA
Electrical Specifications
207
16.7 Control Timing
16.8 Oscillator Characteristics
3. Run (operating) I
DD
measured using external square wave clock source (f
XCLK
= 6 MHz). All inputs 0.2 V from rail. No dc
loads. Less than 100 pF on all outputs. C
L
= 20 pF on OSC2. All ports configured as inputs. OSC2 capacitance linearly
affects run I
DD
. Measured with all modules enabled.
4. Wait I
DD
measured using external square wave clock source (f
XCLK
= 6 MHz); all inputs 0.2 V from rail; no dc loads; less
than 100 pF on all outputs. C
L
= 20 pF on OSC2; 15 k
±
5% termination resistors on D+ and D– pins; all ports configured
as inputs; OSC2 capacitance linearly affects wait I
DD
5. STOP I
DD
measured with USB in suspend mode; OSC1 grounded; transceiver pullup resistor of 1.5 k
±
5% between
V
REG
and D– and 15 k
±
5% termination resistors on D+ and D– pins; no port pins sourcing current.
6. Maximum is highest voltage that POR is guaranteed.
7. If minimum V
REG
is not reached before the internal POR reset is released, RST must be driven low externally until minimum
V
REG
is reached.
Characteristic
(1)
NOTES:
1. V
DD
= 4.0 to 5.5 Vdc; V
SS
= 0 Vdc; timing shown with respect to 20% V
DD
and 70% V
DD
, unless otherwise noted.
2. Some modules may require a minimum frequency greater than dc for proper operation; see appropriate table for this in-
formation.
3. Minimum pulse width reset is guaranteed to be recognized. It is possible for a smaller pulse width to cause a reset.
Symbol
Min
Max
Unit
Internal operating frequency
(2)
f
OP
—
3
MHz
RST input pulse width low
(3)
t
IRL
50
—
ns
Characteristic
Symbol
Min
Typ
Max
Unit
Crystal frequency
(1)
NOTES:
1. The USB module is designed to function at f
XCLK
= 6 MHz.
2. No more than 10% duty cycle deviation from 50%
3. Consult crystal vendor data sheet
4. Not required for high-frequency crystals
f
XCLK
1
—
6
MHz
External clock
Reference frequency
(1), (2)
f
XCLK
dc
—
6
MHz
Crystal load capacitance
(3)
C
L
—
—
—
Crystal fixed capacitance
(3)
C
1
—
2
×
C
L
—
Crystal tuning capacitance
(3)
C
2
—
2
×
C
L
—
Feedback bias resistor
R
B
—
10 M
—
Series resistor
(3), (4)
R
S
—
—
—
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