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參數(shù)資料
| 型號： | MC68HC08JB1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)(低成本、高性能M68HC08系列的8位微控制器(MCUs)) |
| 中文描述： | 低成本，高性能M68HC08系列系列的8位微控制器單元（MCU）（低成本，高性能M68HC08系列系列的8位微控制器（MCU）的） |
| 文件頁數(shù)： | 180/214頁 |
| 文件大?。?/td> | 2186K |
| 代理商： | MC68HC08JB1 |
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External Interrupt (IRQ)
Technical Data
MC68HC08JB1
—
Rev. 1.0
180
External Interrupt (IRQ)
MOTOROLA
12.5 IRQ Pin
The IRQ pin has a low leakage for input voltages ranging from 0V to V
DD
;
suitable for applications using RC discharge circuitry to wake up the
MCU.
A logic 0 on the IRQ pin can latch an interrupt request into the IRQ1
latch. A vector fetch, software clear, or reset clears the IRQ1 latch.
If the MODE1 bit is set, the IRQ pin is both falling-edge-sensitive and
low-level-sensitive. With MODE1 set, both of the following actions must
occur to clear IRQ1:
Vector fetch or software clear — A vector fetch generates an
interrupt acknowledge signal to clear the latch. Software may
generate the interrupt acknowledge signal by writing a logic 1 to
the ACK1 bit in the interrupt status and control register (ISCR).
The ACK1 bit is useful in applications that poll the IRQ pin and
require software to clear the IRQ1 latch. Writing to the ACK1 bit
prior to leaving an interrupt service routine can also prevent
spurious interrupts due to noise. Setting ACK1 does not affect
subsequent transitions on the IRQ pin. A falling edge that occurs
after writing to the ACK1 bit latches another interrupt request. If
the IRQ1 mask bit, IMASK1, is clear, the CPU loads the program
counter with the vector address at locations $FFF8 and $FFF9.
Return of the IRQ pin to logic one — As long as the IRQ pin is at
logic zero, IRQ1 remains active.
The vector fetch or software clear and the return of the IRQ pin to logic
one may occur in any order. The interrupt request remains pending as
long as the IRQ pin is at logic zero. A reset will clear the latch and the
MODE1 control bit, thereby clearing the interrupt even if the pin stays
low.
If the MODE1 bit is clear, the IRQ pin is falling-edge-sensitive only. With
MODE1 clear, a vector fetch or software clear immediately clears the
IRQ1 latch.
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