參數(shù)資料
型號： MC68HC08AZ32AVFU
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： HCMOS Microcontroller Unit
中文描述： 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
封裝： QFP-64
文件頁數(shù)： 20/456頁
文件大小： 3547K
代理商： MC68HC08AZ32AVFU
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List of Figures
Technical Data
MC68HC08AZ32A — Rev 1.0
20
List of Figures
MOTOROLA
18-3
18-4
18-5
19-1
19-2
19-3
19-4
19-5
19-6
19-7
19-8
19-9
19-10 Port D Data Register (PTD) . . . . . . . . . . . . . . . . . . . . . . . . . .304
19-11 Data Direction Register D (DDRD). . . . . . . . . . . . . . . . . . . . .305
19-12 Port D I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .306
19-13 Port E Data Register (PTE) . . . . . . . . . . . . . . . . . . . . . . . . . .307
19-14 Data Direction Register E (DDRE) . . . . . . . . . . . . . . . . . . . . .310
19-15 Port E I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .310
19-16 Port F Data Register (PTF). . . . . . . . . . . . . . . . . . . . . . . . . . .312
19-17 Data Direction Register F (DDRF) . . . . . . . . . . . . . . . . . . . . .313
19-18 Port F I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .314
19-19 Port G Data Register (PTG) . . . . . . . . . . . . . . . . . . . . . . . . . .315
19-20 Data Direction Register G (DDRG). . . . . . . . . . . . . . . . . . . . .316
19-21 Port G I/O Circuit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .316
19-22 Port H Data Register (PTH) . . . . . . . . . . . . . . . . . . . . . . . . . .318
19-23 Data Direction Register H (DDRH). . . . . . . . . . . . . . . . . . . . .319
19-24 Port H I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .319
20-1
The CAN System . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .324
20-2
User Model for Message Buffer Organization. . . . . . . . . . . . .328
20-3
Single 32-Bit Maskable Identifier Acceptance Filter . . . . . . . .331
20-4
Dual 16-Bit Maskable Acceptance Filters. . . . . . . . . . . . . . . .332
20-5
Quadruple 8-Bit Maskable Acceptance Filters . . . . . . . . . . . .333
20-6
Sleep Request/Acknowledge Cycle . . . . . . . . . . . . . . . . . . . .340
20-7
Clocking Scheme . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .343
20-8
Segments Within the Bit Time . . . . . . . . . . . . . . . . . . . . . . . .345
20-9
MSCAN08 Memory Map. . . . . . . . . . . . . . . . . . . . . . . . . . . . .346
20-10 Message Buffer Organization. . . . . . . . . . . . . . . . . . . . . . . . .347
20-11 Receive/Transmit Message Buffer Extended Identifier (IDRn)
PIT Status and Control Register (PSC) . . . . . . . . . . . . . . . . .288
PIT Counter Registers (PCNTH–PCNTL). . . . . . . . . . . . . . . .290
PIT Counter Modulo Registers (PMODH–PMODL) . . . . . . . .291
Port A data register (PTA) . . . . . . . . . . . . . . . . . . . . . . . . . . .295
Data Direction Register A (DDRA). . . . . . . . . . . . . . . . . . . . .296
Port A I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .296
Port B Data Register (PTB) . . . . . . . . . . . . . . . . . . . . . . . . . .298
Data Direction Register B (DDRB) . . . . . . . . . . . . . . . . . . . . .299
Port B I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .299
Port C Data Register (PTC) . . . . . . . . . . . . . . . . . . . . . . . . . .301
Data Direction Register C (DDRC). . . . . . . . . . . . . . . . . . . . .302
Port C I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .303
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
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