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參數(shù)資料
| 型號： | MC68334GEH16 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 64/76頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT 16MHZ 132-PQFP |
| 標準包裝： | 36 |
| 系列： | M683xx |
| 核心處理器： | CPU32 |
| 芯體尺寸： | 32-位 |
| 速度： | 16MHz |
| 連通性： | EBI/EMI，UART/USART |
| 輸入/輸出數(shù)： | 47 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x8/10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 132-BQFP 緩沖式 |
| 包裝： | 托盤 |
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MC68334
MC68334TS/D REV. 1
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ADCTL0 is used to select ADC clock source and to set up prescaling. Writes to it have immediate effect.
RES10 — 10-Bit Resolution
0 = 8-bit resolution
1 = 10-bit resolution
Conversion results are appropriately aligned in result registers to reflect conversion status.
STS[1:0] — Sample Time Select
Total conversion time depends on initial sample time, transfer time, final sample time, and resolution
time. Initial sample time is fixed at two clocks. Transfer time is fixed at two clocks. Resolution time is
fixed at ten ADC clock cycles for an 8-bit conversion and twelve ADC clock cycles for a 10-bit conver-
sion. Final sample time depends on the STS field, as shown below.
PRS[4:0] — Prescaler Rate Selection Field
ADC clock is generated from system clock using a modulo counter and a divide-by-two circuit. The bi-
nary value of this field is the counter modulus. System clock is divided by the PRS value plus one, then
sent to the divide-by-two circuit, as shown in the following table. Maximum ADC clock rate is 2 MHz.
Reset value of PRS is a divisor value of eight, resulting in a nominal 2-MHz ADC clock.
ADCTL0
— A/D Control Register 0
$YFF70A
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
RES10
STS
PRS
RESET:
0
1
STS[1:0]
Sample Time
00
2 A/D Clock Periods
01
4 A/D Clock Periods
10
8 A/D Clock Periods
11
16 A/D Clock Periods
PRS[4:0]
Divisor Value
00000
4
00001
4
00010
6
...
11101
60
11110
62
11111
64
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