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參數(shù)資料
| 型號： | MC3S12Q64MPB16 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | LQFP-52 |
| 文件頁數(shù)： | 434/644頁 |
| 文件大?。?/td> | 3248K |
| 代理商： | MC3S12Q64MPB16 |
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Chapter 1 MC9S12Q Device Overview (MC9S12Q128-Family)
Freescale Semiconductor
MC9S12Q128
49
Rev 1.10
1.3.3
Pin Initialization for 48- and 52-Pin LQFP Bond Out Versions
Not Bonded Pins:
If the port pins are not bonded out in the chosen package the user should initialize the registers to
be inputs with enabled pull resistance to avoid excess current consumption. This applies to the
following pins:
(48LQFP): Port A[7:1], Port B[7:5], Port B[3:0], PortE[6,5,3,2], Port P[7:6], PortP[4:0], Port
J[7:6], PortS[3:2]
(52LQFP): Port A[7:3], Port B[7:5], Port B[3:0], PortE[6,5,3,2], Port P[7:6], PortP[2:0], Port
J[7:6], PortS[3:2]
PP[2:0]
KWP[2:0]
PW[2:0]
VDDX
PERP/
PPSP
Disabled
Port P I/O pins, keypad wake-up, PWM outputs
PJ[7:6]
KWJ[7:6]
—
VDDX
PERJ/
PPSJ
Disabled
Port J I/O pins and keypad wake-up
PM5
SCK
—
VDDX
PERM/
PPSM
Up
Port M I/O pin and SPI SCK signal
PM4
MOSI
—
VDDX
PERM/
PPSM
Up
Port M I/O pin and SPI MOSI signal
PM3
SS
—
VDDX
PERM/
PPSM
Up
Port M I/O pin and SPI SS signal
PM2
MISO
—
VDDX
PERM/
PPSM
Up
Port M I/O pin and SPI MISO signal
PM1
TXCAN
—
VDDX
PERM/
PPSM
Up
Port M I/O pin and CAN transmit signal
PM0
RXCAN
—
VDDX
PERM/
PPSM
Up
Port M I/O pin and CAN receive signal
PS[3:2]
—
VDDX
PERS/
PPSS
Up
Port S I/O pins
PS1
TXD
—
VDDX
PERS/
PPSS
Up
Port S I/O pin and SCI transmit signal
PS0
RXD
—
VDDX
PERS/
PPSS
Up
Port S I/O pin and SCI receive signal
PT[7:5]
IOC[7:5]
—
VDDX
PERT/
PPST
Disabled
Port T I/O pins shared with timer (TIM)
PT[4:0]
IOC[4:2]
PW[3:0]
VDDX
PERT/
PPST
Disabled
Port T I/O pins shared with timer and PWM
1. The Port E output buffer enable signal control at reset is determined by the PEAR register and is mode dependent. For
example, in special test mode RDWE = LSTRE = 1 which enables the PE[3:2] output buffers and disables the pull-ups. Refer
to S12_MEBI user guide for PEAR register details.
Table 1-5. Signal Properties (continued)
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Power
Domain
Internal Pull
Resistor
Description
CTRL
Reset
State
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC3S12Q64MPB8 | 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP52 |
| MC56603APV60 | 24-BIT, 60 MHz, OTHER DSP, PQFP144 |
| MC56603AGC60 | 24-BIT, 60 MHz, OTHER DSP, PBGA144 |
| MC56F8014MFAE | 0-BIT, 8 MHz, OTHER DSP, PQFP32 |
| MC56F8014VFAE | 0-BIT, 8 MHz, OTHER DSP, PQFP32 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC3S12Q64MPB8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q64VFA16 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q64VFA8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q64VPB16 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q64VPB8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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