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參數(shù)資料
| 型號： | MC3S12Q128VFA16 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP48 |
| 封裝： | LQFP-48 |
| 文件頁數(shù)： | 329/644頁 |
| 文件大?。?/td> | 3248K |
| 代理商： | MC3S12Q128VFA16 |
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Chapter 13 Serial Communications Interface (S12SCIV2) Block Description
Freescale Semiconductor
MC9S12Q128
395
Rev 1.10
If software clears TE while a transmission is in progress (TC = 0), the frame in the transmit shift register
continues to shift out. To avoid accidentally cutting off the last frame in a message, always wait for TDRE
to go high after the last frame before clearing TE.
To separate messages with preambles with minimum idle line time, use this sequence between messages:
1. Write the last byte of the rst message to SCIDRH/L.
2. Wait for the TDRE ag to go high, indicating the transfer of the last frame to the transmit shift
register.
3. Queue a preamble by clearing and then setting the TE bit.
4. Write the rst byte of the second message to SCIDRH/L.
13.4.3.3
Break Characters
Writing a logic 1 to the send break bit, SBK, in SCI control register 2 (SCICR2) loads the transmit shift
register with a break character. A break character contains all logic 0s and has no start, stop, or parity bit.
Break character length depends on the M bit in SCI control register 1 (SCICR1). As long as SBK is at
logic 1, transmitter logic continuously loads break characters into the transmit shift register. After software
clears the SBK bit, the shift register nishes transmitting the last break character and then transmits at least
one logic 1. The automatic logic 1 at the end of a break character guarantees the recognition of the start bit
of the next frame.
The SCI recognizes a break character when a start bit is followed by eight or nine logic 0 data bits and a
logic 0 where the stop bit should be. Receiving a break character has these effects on SCI registers:
Sets the framing error ag, FE
Sets the receive data register full ag, RDRF
Clears the SCI data registers (SCIDRH/L)
May set the overrun ag, OR, noise ag, NF, parity error ag, PE, or the receiver active ag, RAF
13.4.3.4
Idle Characters
An idle character contains all logic 1s and has no start, stop, or parity bit. Idle character length depends on
the M bit in SCI control register 1 (SCICR1). The preamble is a synchronizing idle character that begins
the rst transmission initiated after writing the TE bit from 0 to 1.
If the TE bit is cleared during a transmission, the Tx output signal becomes idle after completion of the
transmission in progress. Clearing and then setting the TE bit during a transmission queues an idle
character to be sent after the frame currently being transmitted.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M30875FHGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP144 |
| MB90803PF-G | 16-BIT, MROM, 25 MHz, MICROCONTROLLER, PQFP100 |
| MPC8255CZUHFBXXX | 32-BIT, 166 MHz, RISC PROCESSOR, PBGA480 |
| MPC8347VRALF | 32-BIT, 667 MHz, RISC PROCESSOR, PBGA620 |
| MC9S12XEP100F1CAL | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC3S12Q128VFA8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q128VFU16 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q128VFU8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q128VPB16 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC3S12Q128VPB8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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