參數(shù)資料
型號： MAX3872EGJ
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 數(shù)字傳輸電路
英文描述： Multirate Clock and Data Recovery with Limiting Amplifier
中文描述： CLOCK RECOVERY CIRCUIT, QCC32
封裝： 5 X 5 MM, 0.90 MM HEIGHT, MO-220, QFN-32
文件頁數(shù)： 5/13頁
文件大?。?/td> 580K
代理商： MAX3872EGJ
M
Multirate Clock and Data Recovery
with Limiting Amplifier
_______________________________________________________________________________________
5
RECOVERED CLOCK AND DATA
(2.488Gbps, 2
23
- 1 PATTERN, V
IN
= 10mV
P-P
)
M
200mV/
div
100ps/div
RECOVERED CLOCK AND DATA
(2.67Gbps, 2
23
- 1 PATTERN, V
IN
= 10mV
P-P
)
M
200mV/
div
100ps/div
RECOVERED CLOCK JITTER
(2.488Gbps)
M
10ps/div
TOTAL WIDEBAND RMS JITTER = 1.60ps
PEAK-TO-PEAK JITTER = 12.20ps
RECOVERED CLOCK JITTER
(622.08Mbps)
M
10ps/div
TOTAL WIDEBAND RMS JITTER = 2.17ps
PEAK-TO-PEAK JITTER = 15.80ps
0.0
0.5
1.0
1.5
2.0
2.5
3.0
3.5
4.0
0
10
5
15
20
25
30
JITTER GENERATION
vs. POWER-SUPPLY WHITE NOISE
M
WHITE-NOISE AMPLITUDE (mV
RMS
)
J
R
)
OC-48
PRBS = 2
23
- 1
Typical Operating Characteristics
(V
CC
= +3.3V, T
A
= +25
°
C, unless otherwise noted.)
SCLKO+
SDO
t
CLK
t
CLK-Q
Figure 3. Definition of Clock-to-Q Delay
INPUT DATA
ACQUISITION TIME
DATA
DATA
LOL OUTPUT
LOL ASSERT TIME
Figure 4.
LOL
Assert Time and PLL Acquisition Time
Measurement
Timing Diagrams (continued)
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