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參數(shù)資料
| 型號(hào)： | m789456 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers |
| 中文描述： | 8位單芯片微控制器 |
| 文件頁(yè)數(shù)： | 203/321頁(yè) |
| 文件大?。?/td> | 1378K |
| 代理商： | M789456 |
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CHAPTER 9 8-BIT TIMERS H0 AND H1
User’s Manual U17260EJ6V0UD
281
9.4.2 Operation as PWM output
In PWM output mode, a pulse with an arbitrary duty and arbitrary cycle can be output.
The 8-bit timer compare register 0n (CMP0n) controls the cycle of timer output (TOHn). Rewriting the CMP0n
register during timer operation is prohibited.
The 8-bit timer compare register 1n (CMP1n) controls the duty of timer output (TOHn). Rewriting the CMP1n
register during timer operation is possible.
The operation in PWM output mode is as follows.
PWM output (TOHn output) outputs an active level and 8-bit timer counter Hn is cleared to 0 when 8-bit timer
counter Hn and the CMP0n register match after the timer count is started. PWM output (TOHn output) outputs an
inactive level when 8-bit timer counter Hn and the CMP1n register match.
Setting
<1>
Set each register.
Figure 9-11. Register Setting in PWM Output Mode
(i)
Setting timer H mode register n (TMHMDn)
0
0/1
1
0
0/1
1
TMMDn0 TOLEVn
TOENn
CKSn1
CKSn2
TMHEn
TMHMDn
CKSn0
TMMDn1
Timer output enabled
Default setting of timer output level
PWM output mode selection
Count clock (fCNT) selection
Count operation stopped
(ii) Setting CMP0n register
Compare value (N): Cycle setting
(iii) Setting CMP1n register
Compare value (M): Duty setting
Remarks 1. n = 0, 1
2. 00H
≤ CMP1n (M) < CMP0n (N) ≤ FFH
<2>
The count operation starts when TMHEn = 1.
<3>
The CMP0n register is the compare register that is to be compared first after counter operation is enabled.
When the values of the 8-bit timer counter Hn and the CMP0n register match, the 8-bit timer counter Hn is
cleared, an interrupt request signal (INTTMHn) is generated, and an active level is output. At the same time,
the compare register to be compared with the 8-bit timer counter Hn is changed from the CMP0n register to
the CMP1n register.
<4>
When the 8-bit timer counter Hn and the CMP1n register match, an inactive level is output and the compare
register to be compared with the 8-bit timer counter Hn is changed from the CMP1n register to the CMP0n
register. At this time, the 8-bit timer counter Hn is not cleared and the INTTMHn signal is not generated.
<R>
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