參數(shù)資料
型號: M4A3-64/64-12VNI
廠商: Lattice Semiconductor Corporation
文件頁數(shù): 3/62頁
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描述: IC CPLD ISP 4A 64MC 100TQFP
標準包裝: 90
系列: ispMACH® 4A
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1): 12.0ns
電壓電源 - 內(nèi)部: 3 V ~ 3.6 V
宏單元數(shù): 64
輸入/輸出數(shù): 64
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 100-LQFP
供應商設備封裝: 100-TQFP(14x14)
包裝: 托盤
ispMACH 4A Family
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The flip-flop can be configured as a D-type or T-type latch. J-K or S-R registers can be synthesized. The
primary flip-flop configurations are shown in Figure 6, although others are possible. Flip-flop functionality
is defined in Table 8. Note that a J-K latch is inadvisable as it will cause oscillation if both J and K inputs
are HIGH.
DQ
AP AR
DQ
AP AR
LQ
AP AR
LQ
AP AR
G
TQ
AP AR
17466G-011
Figure 6. Primary Macrocell Congurations
g. Combinatorial with programmable polarity
a. D-type with XOR
b. D-type with programmable D polarity
c. Latch with XOR
d. Latch with programmable D polarity
e. T-type with programmable T polarity
f. Combinatorial with XOR
相關PDF資料
PDF描述
ISPLSI 1016EA-100LJ44 IC PLD ISP 32I/O 100MHZ 44PLCC
VI-B2X-CY-F4 CONVERTER MOD DC/DC 5.2V 50W
TPSE477M010R0050 CAP TANT 470UF 10V 20% 2917
R05P215S/X2/R6.4 CONV DC/DC 2W 05VIN 15VOUT
GRM21BR71C474KA01L CAP CER 0.47UF 16V 10% X7R 0805
相關代理商/技術參數(shù)
參數(shù)描述
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