參數(shù)資料
型號： M4A3-256/128-7VI
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： PLD
英文描述： CAP 1500UF 100V ELECT KMH SNAP
中文描述： EE PLD, 7.5 ns, PQFP176
封裝： TQFP-176
文件頁數(shù)： 41/62頁
文件大?。?/td> 2620K
代理商： M4A3-256/128-7VI
46
MACH 4 Family
CAPACITANCE 1
Note:
1. These parameters are not 100% tested, but are calculated at initial characterization and at any time the design is modied
where this parameter may be affected.
ICC vs. FREQUENCY
These curves represent the typical power consumption for a particular device at system
frequency. The selected “typical” pattern is a 16-bit up-down counter. This pattern lls the
device and exercises every macrocell. Maximum frequency shown uses internal feedback and
a D-type register. Power/Speed are optimized to obtain the highest counter frequency and the
lowest power. The highest frequency (LSBs) is placed in common PAL blocks, which are set to
high power. The lowest frequency signals (MSBs) are placed in a common PAL block and set to
lowest power.
Parameter Symbol
Parameter Description
Test Conditions
Typ
Unit
CIN
Input capacitance
VIN=2.0 V
3.3 V or 5 V, 25°C, 1 MHz
6
pF
CI/O
Output capacitance
VOUT=2.0V
3.3 V or 5 V, 25°C, 1 MHz
8
pF
350
300
250
200
150
100
50
0
10
20
30
40
50
60
70
80
90
100
110
120
130
VCC = 5 V or 3.3 V, TA = 25 °C
I CC
(mA)
Frequency (MHz)
17466G-066
M4(LV)-32/32
M4(LV)-64/32
M4(LV)-96/48
M4(LV)-128/64
M4(LV)-192/96
M4(LV)-256/128
Figure 19. ICC Curves at High Power Mode
17466G-044
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PDF描述
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