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參數(shù)資料
| 型號： | M3823AGF-XXXHP |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單芯片8位CMOS微機(jī) |
| 文件頁數(shù)： | 70/76頁 |
| 文件大?。?/td> | 896K |
| 代理商： | M3823AGF-XXXHP |
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Rev.2.02 Jun 19, 2007 page 70 of 73
REJ03B0146-0202
3823 Group
(V
CC
= 4.0 to 5.5 V, V
SS
= 0 V, Ta = –20 to 85 °C, unless otherwise noted)
Note :
When the P4
5
/T
X
D P-channel output disable bit of the UART control register (bit 4 of address 001B
16
) is “0”.
Serial I/O clock output “H” pulse width
Serial I/O clock output “L” pulse width
Serial I/O output delay time
(Note)
Serial I/O output valid time
(Note)
Serial I/O clock output rising time
Serial I/O clock output falling time
140
30
30
Symbol
Parameter
Limits
Min.
ns
ns
ns
ns
ns
ns
Unit
t
C
(S
CLK
)/2–30
t
C
(S
CLK
)/2–30
–30
Typ.
Max.
t
wH(S
CLK
)
t
wL(S
CLK
)
t
d(S
CLK
–T
X
D)
t
v(S
CLK
–T
X
D)
t
r(S
CLK
)
t
f(S
CLK
)
(V
CC
= 1.8 to 4.0 V, V
SS
= 0 V, Ta = –20 to 85 °C, unless otherwise noted)
ns
ns
ns
ns
ns
ns
Unit
Note :
When the P4
5
/T
X
D P-channel output disable bit of the UART control register (bit 4 of address 001B
16
) is “0”.
Serial I/O clock output “H” pulse width
Serial I/O clock output “L” pulse width
Serial I/O output delay time
(Note)
Serial I/O output valid time
(Note)
Serial I/O clock output rising time
Serial I/O clock output falling time
350
100
100
Symbol
Parameter
Limits
Min.
t
C
(S
CLK
)/2–100
t
C
(S
CLK
)/2–100
–30
Max.
t
wH(S
CLK
)
twL(S
CLK
)
t
d(S
CLK
–T
X
D)
t
v(S
CLK
–T
X
D)
t
r(S
CLK
)
t
f(S
CLK
)
Typ.
Fig. 69 Circuit for measuring output switching characteristics
Table 24
Switching characteristics (1)
Table 25
Switching characteristics (2)
M
e
a
s
u
r
e
m
e
n
t
o
u
t
p
u
t
p
i
n
1
0
0
p
F
C
M
O
S
o
u
t
p
u
t
Note:
When bit 4 of the UART control register
(address 001B
16
) is “1”. (N-channel open-
drain output mode)
N-channel open-drain output
(Note)
1
k
100 pF
Measurement output pin
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