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參數(shù)資料
| 型號： | M3823AGF-XXXHP |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單芯片8位CMOS微機(jī) |
| 文件頁數(shù)： | 27/76頁 |
| 文件大?。?/td> | 896K |
| 代理商： | M3823AGF-XXXHP |
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Rev.2.02 Jun 19, 2007 page 27 of 73
REJ03B0146-0202
3823 Group
Fig. 20 Timing of interrupt request generation, interrupt request bit, and interrupt acceptance
Internal clock
φ
SYNC
Instruction cycle
T1
IR1 T2
T1 T2 T3: Interrupt acceptance timing points
IR1 IR2: Timings points at which the interrupt request bit is set to “1”.
Push onto stack
Vector fetch
Instruction cycle
IR2 T3
Note: Period 2 indicates the last
φ
cycle during one instruction cycle.
(1) The interrupt request bit for an interrupt request generated during period 1 is set to “1” at timing point IR1.
(2) The interrupt request bit for an interrupt request generated during period 2 is set to “1” at timing point IR1 or IR2.
The timing point at which the bit is set to “1” varies depending on conditions. When two or more interrupt requests
are generated during the period 2, each request bit may be set to “1” at timing point IR1 or IR2 separately.
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