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參數(shù)資料
| 型號(hào)： | M38223E4-XXXGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 14 MM, PLASTIC, QFP-80 |
| 文件頁(yè)數(shù)： | 71/328頁(yè) |
| 文件大?。?/td> | 2300K |
| 代理商： | M38223E4-XXXGP |
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APPLICATION
2.4 Timer 1, timer 2, and timer 3
3822 GROUP USER’S MANUAL
2–96
Fig. 2.4.11 Structure of interrupt control register 1
(4) Interrupt control register 1 (ICON1) and interrupt control register 2 (ICON2)
The interrupt control register 1 (address 003E16) and the interruot contorol register 2 (address 003F16)
control each interrupt request source.
Figure 2.4.11 shows the structure of the interrupt control register 1 and Figure 2.4.12 shows the
structure of the interrupt control register 2.
When an interrupt enable bit is “0,” the corresponding interrupt request is disabled. If an interrupt
request occurs when this bit is “0,” the corresponding interrupt request bit only is set to “1,” and the
interrupt request is not accepted.
When the interrupt enable bit is “1,” the corresponding interrupt request is enabled. If an interrupt
request occurs when this bit is “1,” the interrupt request is accepted (interrupt disable flag = “0”).
Each interrupt enable bit can be set to “0” or “1” by software.
For details of interrupts, refer to “2.2 Interrupts.”
b7 b6 b5 b4 b3 b2 b1 b0
Interrupt control register 1 (ICON1) [Address 3E16]
B
Name
Functions
At reset RW
Interrupt control register 1
0
INT0 interrupt enable
bit
0 : Interrupts disabled
1 : Interrupts enabled
0
1
INT1 interrupt enable
bit
0
2
Serial I/O receive
interrupt enable bit
0
3
Serial I/O transmit
interrupt enable bit
0
4
Timer X interrupt
enable bit
0
5
Timer Y interrupt
enable bit
0
6
Timer 2 interrupt
enable bit
0
7
Timer 3 interrupt
enable bit
0
0 : Interrupts disabled
1 : Interrupts enabled
0 : Interrupts disabled
1 : Interrupts enabled
0 : Interrupts disabled
1 : Interrupts enabled
0 : Interrupts disabled
1 : Interrupts enabled
0 : Interrupts disabled
1 : Interrupts enabled
0 : Interrupts disabled
1 : Interrupts enabled
0 : Interrupts disabled
1 : Interrupts enabled
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