參數(shù)資料
型號(hào)： M37280MK-XXXSP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8.1 MHz, MICROCONTROLLER, PDIP64
封裝： 0.750 INCH, 1.78 MM PITCH, PLASTIC, SDIP-64
文件頁(yè)數(shù)： 61/181頁(yè)
文件大?。?/td> 1878K
代理商： M37280MK-XXXSP
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150
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER with CLOSED CAPTION DECODER
and ON-SCREEN DISPLAY CONTROLLER
M37280MF–XXXSP, M37280MK–XXXSP
M37280EKSP
MITSUBISHI MICROCOMPUTERS
PRELIMINAR
Y
Notice:
This
is not
a final
specification.
Some
paramentic
limits
are
subject
to change.
Rev. 1.0
Address 00E416
b7 b6 b5 b4 b3 b2 b1 b0
Clock run-in detect register (CRD) [Address 00EA16]
R W
Clock Run-in Detect Register
0
to
2
0
R—
Test bits
3
to
7
Number of reference clocks to
be counted in one clock run-in
pulse period.
Clock run-in detection
bit(CRD3 to CRD7)
0R —
Read-only
B
After reset
Functions
Name
Address 00E616
Address 00E916
b7 b6 b5 b4 b3 b2 b1 b0
Caption Position Register (CPS) [Address 00E616]
Caption Position Register
0
to
4
0
RW
0R W
Caption position
bits(CPS0 to CPS4)
6, 7
Refer to the corresponding
Table (Table 12.10.1).
Slice line mode
specification bits
(in 1 field) (CPS6, CPS7)
5
0: Data is not latched yet and a
clock-run-in is not determined.
1: Data is latched and a
clock-run-in is determined.
Caption data latch
completion flag 2
(CPS5)
Indeterminate R—
B
After reset
Functions
Name
RW
b7 b6 b5 b4 b3 b2 b1 b0
Sync pulse counter register (HC) [Address 00E916]
R W
Sync Pulse Counter Register
0
to
4
Indeterminate R —
6, 7
0
R —
Count value (HC0 to HC4)
5
0
R W
Count source (HC5)
0: HSYNC signal
1: Composite sync signal
B
After reset
Functions
Name
Nothing is assigned. These bits are write disable bits.
When these bits are read out, the values are “0.”
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PDF描述
M37280MKH-XXXSP 8-BIT, MROM, 8.1 MHz, MICROCONTROLLER, PDIP64
M37280MFH-XXXSP 8-BIT, MROM, 8.1 MHz, MICROCONTROLLER, PDIP64
M37281MFH-XXXSP 8-BIT, MROM, 8.1 MHz, MICROCONTROLLER, PDIP52
M37281MAH-XXXSP 8-BIT, MROM, 8.1 MHz, MICROCONTROLLER, PDIP52
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