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參數(shù)資料
| 型號(hào)： | M306K9FCLRP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP144 |
| 封裝： | 16 X 16 MM, 0.40 MM PITCH, PLASTIC, TQFP-144 |
| 文件頁數(shù)： | 70/294頁 |
| 文件大?。?/td> | 2600K |
| 代理商： | M306K9FCLRP |
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LPC Bus Interface
Rev.1.00
Jun 06, 2003
page 159 of 290
M16C/6K9 Group
<2> Example for I/O reading cycle from HOST
Reading timing is shown in Figure GF-9.
The basic communication cycles of LPC I/O protocol are 13 cycles. The data of LAD[3:0] will be read by the
_______________
rising edge of LCLK. Communication will start from LFRAME falling edge.
_______________
1st cycle: When LFRAME is "Low", sending "00002 " to LAD[3:0] for communication start detecting.
_______________
2ndcycle: When LFRAME is "High", the host send "000X2 " on LAD[3:0] to inform the cycle type as I/O read.
From 3rd cycle to 6thcycle: These four cycles are detecting for 16 bits slave address.
3rdcycle: The slave address which is from host is written to slave address register [15:12] throughLAD[3:0]
4thcycle: The slave address which is from host is written to slave address register [11:8] throughLAD[3:0]
5thcycle: The slave address which is from host is written to slave address register [7:4] throughLAD[3:0]
6thcycle: The slave address which is from host is written to slave address register [3:0] throughLAD[3:0]
7th and 8thcycles are used for changing the communication direction from host
→slave to slave→host
7thcycle: Host is output "11112 " to LAD[3:0]
8thcycle: The LAD[3:0] will be set to Hi-Z by HOST to switch the communication direction.
9thcycle : The "00002 " (SYNC OK) is output to LAD[3:0] for acknowledge.
10th and 11thcycles are for output 8 bits data from output data buffer or output 8 bits data from status register.
10thcycle: Sending output data buffer [3:0] to LAD[3:0] or sending data of status register [3:0] to LAD[3:0]
11thcycle: Sending output data buffer [7:4] to LAD[3:0] or sending data of status register [7:4] to LAD[3:0].
12thcycle: The "11112 " is output to LAD[3:0]. The OBF flag is cleared and OBE interrupt signal is generated.
13thcycle: The LAD[3:0] will be set to Hi-Z by slave to switch the communication direction. OBF flag will be
set when 8 bits data are written to output data buffer by slave CPU.
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