參數(shù)資料
型號： M30281M8V-XXXHP
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP64
封裝： 10 X 10 MM, 0.50 MM PITCH, PLASTIC, LQFP-64
文件頁數(shù)： 152/416頁
文件大?。?/td> 3065K
代理商： M30281M8V-XXXHP
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15. A/D Converter
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M
Figure 15.5 TB2SC Register
PWCOM
Symbol
Address
After Reset
TB2SC
039E16
X00000002
Timer B2 reload timing
switch bit
0: Timer B2 underflow
1: Timer A output at odd-numbered
Timer B2 Special Mode Register (1)
Bit Name
Function
Bit Symbol
b7 b6 b5 b4 b3 b2 b1 b0
IVPCR1 Three-phase output port
SD control bit 1
(3, 4, 7)
0: Three-phase output forcible cutoff
by SD pin input (high impedance)
disabled
1: Three-phase output forcible cutoff
by SD pin input (high impedance)
enabled
NOTES:
1. Write to this register after setting the PRC1 bit in the PRCR register to 1 (write enabled).
2. If the INV11 bit is 0 (three-phase mode 0) or the INV06 bit is 1 (triangular wave modulation mode), set this bit to
0 (timer B2 underflow).
RW
(2)
Nothing is assigned. If necessary, set to 0.
When read, its content is 0
(b7)
TB2SEL Trigger select bit
0: TB2 interrupt
1: Underflow of TB2 interrupt generation
frequency setting counter [ICTB2](6)
RW
TB0EN
Timer B0 operation mode
select bit
0: Other than A/D trigger mode
1: A/D trigger mode(5)
RW
TB1EN
Timer B1 operation mode
select bit
0: Other than A/D trigger mode
1: A/D trigger mode(5)
RW
3. When setting the IVPCR1 bit to 1 (three-phase output forcible cutoff by SD pin input enabled), set the PD85 bit to
0 (= input mode).
4. Related pins are U(P80), U(P81), V(P72), V(P73), W(P74), W(P75). After forcible cutoff, input "H" to the P85/NMI/SD
pin. Set the IVPCR1 bit to 0, and this forcible cutoff will be reset. If “L” is input to the P85/NMI/SD pin, a three-phase
motor control timer output will be disabled (INV03=0). At this time, when the IVPCR1 bit is 0, the target pins changes
to programmable I/O port. When the IVPCR1 bit is 1, the target pins changes to high-impedance state regardless of
which functions of those pins are used.
5. When using in delay trigger mode, set both bits TB0EN and TB1EN to 1.
6. When setting the TB2SEL bit to 1 (underflow of TB2 interrupt generation frequency setting counter[ICTB2]), set the
INV02 bit to 1 (three-phase motor control timer function).
7. Refer to 18.6 Digital Debounce function for SD input.
(b6-b5)
Reserved bit
Set to 0
0 0
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PDF描述
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