參數(shù)資料
型號(hào)： LMX2352TM
廠商： NATIONAL SEMICONDUCTOR CORP
元件分類(lèi)： XO, clock
英文描述： CAP,CER,DISC,RAD,100PF,10%,1KV
中文描述： PLL FREQUENCY SYNTHESIZER, 1200 MHz, PDSO24
封裝： PLASTIC, TSSOP-24
文件頁(yè)數(shù)： 18/20頁(yè)
文件大?。?/td> 378K
代理商： LMX2352TM
Programming Description
(Continued)
4.6 LOCK DETECT DIGITAL FILTER
The Lock Detect Digital Filter compares the difference between the phase of the inputs of the phase detector to a RC generated
delay of approximately 15nS. To enter the locked state (Lock = HIGH) the phase error must be less than the 15nS RC delay for
5 consecutive reference cycles. Once in lock (Lock = HIGH), the RC delay is changed to approximately 30nS. To exit the locked
state (Lock = LOW), the phase error must become greater than the 30nS RC delay. When the PLL is in the power down mode,
Lock is forced LOW. A flow chart of the digital filter is shown at right.
DS100831-4
www.national.com
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PDF描述
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參數(shù)描述
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