參數(shù)資料
型號(hào): LMK04001BISQ/NOPB
廠商: National Semiconductor
文件頁數(shù): 36/65頁
文件大?。?/td> 0K
描述: IC CLOCK CONDITIONER W/PLL 48LLP
標(biāo)準(zhǔn)包裝: 1,000
系列: PowerWise®
類型: 時(shí)鐘調(diào)節(jié)器
PLL:
輸入: LVCMOS
輸出: LVCMOS,2VPECL,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 2:7
差分 - 輸入:輸出: 是/是
頻率 - 最大: 1.57GHz
除法器/乘法器: 是/是
電源電壓: 3.15 V ~ 3.45 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 48-WFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝: 48-LLP(7x7)
包裝: 帶卷 (TR)
其它名稱: LMK04001BISQ
SNOSAZ8J – SEPTEMBER 2008 – REVISED SEPTEMBER 2011
Table 29. PLL_MUX: LD Pin Selectable Outputs
PLL_MUX [4:0]
LD Output
b4
b3
b2
b1
b0
0
HiZ
0
1
Logic High
0
1
0
Logic Low
0
1
PLL2 Digital Lock Detect Active High
0
1
0
PLL2 Digital Lock Detect Active Low
0
1
0
1
PLL2 Analog Lock Detect Push Pull
0
1
0
PLL2 Analog Lock Detect Open Drain NMOS
0
1
PLL2 Analog Lock Detect Open Drain PMOS
0
1
0
Reserved
0
1
0
1
PLL2_N Divider Output / 2
0
1
0
1
0
Reserved
0
1
0
1
PLL2_R Divider Output / 2
0
1
0
Reserved
0
1
0
1
Reserved
0
1
0
PLL1 Digital Lock Detect Active HIGH
0
1
PLL1 Digital Lock Detect Active LOW
1
0
Reserved
1
0
1
Reserved
1
0
1
0
Reserved
1
0
1
Reserved
1
0
1
0
PLL1_N Divider Output / 2
1
0
1
0
1
Reserved
1
0
1
0
PLL1_R Divider Output / 2
1
0
1
PLL1 and PLL2 Digital Lock Detect
1
0
Inverted PLL1 and PLL2 Digital Lock Detect
1
0
1
Reserved
1
0
1
0
Reserved
1
0
1
Reserved
1
0
Reserved
1
0
1
Reserved
1
0
Reserved
1
Reserved
Copyright 2008–2011, Texas Instruments Incorporated
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PDF描述
VI-JVY-MZ-F3 CONVERTER MOD DC/DC 3.3V 16.5W
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LMK04033BISQ/NOPB IC CLOCK CONDITIONER PREC 48LLP
VI-JVN-MZ-F2 CONVERTER MOD DC/DC 18.5V 25W
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參數(shù)描述
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