參數(shù)資料
型號: KMSC7119VM1200
廠商: Freescale Semiconductor
文件頁數(shù): 22/60頁
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描述: DSP 16BIT W/DDR CTRLR 400-MAPBGA
標(biāo)準(zhǔn)包裝: 2
系列: StarCore
類型: 定點
接口: 主機(jī)接口,I²C,UART
時鐘速率: 300MHz
非易失內(nèi)存: ROM(8 kB)
芯片上RAM: 464kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.20V
工作溫度: -40°C ~ 105°C
安裝類型: 表面貼裝
封裝/外殼: 400-LFBGA
供應(yīng)商設(shè)備封裝: 400-MAPBGA(17x17)
包裝: 托盤
Electrical Characteristics
MSC7119 Data Sheet, Rev. 8
Freescale Semiconductor
29
2.5.6
Ethernet Timing
2.5.6.1
Receive Signal Timing
Figure 9. TDM Transmit Signals
Table 21. Receive Signal Timing
No.
Characteristics
Min
Max
Unit
800
Receive clock period:
MII: RXCLK (max frequency = 25 MHz)
RMII: REFCLK (max frequency = 50 MHz)
40
20
ns
801
Receive clock pulse width high—as a percent of clock period
MII: RXCLK
RMII: REFCLK
35
14
7
65
%
ns
802
Receive clock pulse width low—as a percent of clock period:
MII: RXCLK
RMII: REFCLK
35
14
7
65
%
ns
803
RXDn, RX_DV, CRS_DV, RX_ER to receive clock rising edge setup time
4
ns
804
Receive clock rising edge to RXDn, RX_DV, CRS_DV, RX_ER hold time
2
ns
Figure 10. Ethernet Receive Signal Timing
TDMxTCK
TDMxTD
~ ~
306
307
309
308
300
301
302
311
310
TDMxRCK
TDMxTFS (output)
TDMxTFS (input)
303
305
Valid
Receive
RX_DV
RXDn
RX_ER
803
804
clock
800
802
801
CRS_DV
相關(guān)PDF資料
PDF描述
KMSC7118VF1200 DSP 16BIT W/DDR CTRLR 400-MAPBGA
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KMSC7116VM1000 DSP 16BIT W/DDR CTRLR 400-MAPBGA
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參數(shù)描述
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KMSC8122TMP6400 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MSC8122TMP6400 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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