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參數(shù)資料
| 型號： | JC68HRC908JK3 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | M68HC08 Microcontrollers |
| 中文描述： | M68HC08系列微控制器 |
| 文件頁數(shù)： | 106/212頁 |
| 文件大?。?/td> | 955K |
| 代理商： | JC68HRC908JK3 |
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Monitor ROM (MON)
Technical Data
MC68H(R)C908JL3
—
Rev. 1.1
104
Monitor ROM (MON)
Freescale Semiconductor
9.4.1 Entering Monitor Mode
Table 9-1
shows the pin conditions for entering monitor mode. As
specified in the table, monitor mode may be entered after a POR and will
allow communication at 9600 baud provided one of the following sets of
conditions is met:
1.
If IRQ1 = V
DD
+ V
HI
:
–
External clock on OSC1 is 4.9125MHz
–
PTB3 = low
2.
If IRQ1 = V
DD
+ V
HI
:
–
External clock on OSC1 is 9.8304MHz
–
PTB3 = high
3.
If $FFFE & $FFFF is blank (contains $FF):
–
The oscillator clock is 9.8304MHz (X-tal or RC)
–
IRQ1 = V
DD
Table 9-1. Monitor Mode Entry Requirements and Options
I
$
a
$
P
P
P
P
Clock Source
and
Frequency
Bus
Frequency
Comments
V
DD
+ V
HI
X
0
0
1
1
OSC1 at
4.9152MHz
2.4576MHz
Bypasses X-tal or RC
oscillator; external clock
driven directly into OSC1.
9600 baud communication
on PTB0. COP disabled.
V
DD
+ V
HI
X
1
0
1
1
OSC1 at
9.8304MHz
2.4576MHz
V
DD
BLANK
(contain
$FF)
X
X
X
1
X-tal or RC
oscillator at
9.8304MHz
2.4576MHz
Low-voltage entry to
monitor mode.
9600 baud communication
on PTB0. COP disabled.
V
DD
NOT
BLANK
X
X
X
X
X-tal or RC
oscillator at
desired frequency
XTALCLK ÷ 4
or
RCCLK ÷ 4
Enters User mode.
If $FFFE and $FFFF is
blank, MCU will encounter
an illegal address reset.
Notes:
1. PTB3 = 0: Bypasses the divide-by-two prescaler to SIM when using V
DD
+ V
HI
for monitor mode entry.
The OSC1 clock must be 50% duty cycle for this condition.
2. XTALCLK is the X-tal oscillator output, for MC68HC908xxx. See
Figure 8-1
.
4. RCCLK is the RC oscillator output, for MC68HRC908xxx. See
Figure 8-2
.
5. See
Table 18-4
for V
DD
+ V
HI
voltage level requirements.
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