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參數(shù)資料
| 型號： | JC68HRC908JK3 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | M68HC08 Microcontrollers |
| 中文描述： | M68HC08系列微控制器 |
| 文件頁數(shù)： | 30/212頁 |
| 文件大?。?/td> | 955K |
| 代理商： | JC68HRC908JK3 |
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Memory
Technical Data
MC68H(R)C908JL3
—
Rev. 1.1
30
Memory
Freescale Semiconductor
Addr.
Register Name
Bit 7
6
5
4
3
2
1
Bit 0
$0000
Port A Data Register
(PTA)
Read:
0
PTA6
PTA5
PTA4
PTA3
PTA2
PTA1
PTA0
Write:
Reset:
Unaffected by reset
$0001
Port B Data Register
(PTB)
Read:
PTB7
PTB6
PTB5
PTB4
PTB3
PTB2
PTB1
PTB0
Write:
Reset:
Unaffected by reset
$0002
Unimplemented
Read:
Write:
$0003
Port D Data Register
(PTD)
Read:
PTD7
PTD6
PTD5
PTD4
PTD3
PTD2
PTD1
PTD0
Write:
Reset:
Unaffected by reset
$0004
Data Direction Register A
(DDRA)
Read:
0
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
0
0
0
0
0
0
0
0
$0005
Data Direction Register B
(DDRB)
Read:
DDRB7
DDRB6
DDRB5
DDRB4
DDRB3
DDRB2
DDRB1
DDRB0
Write:
Reset:
0
0
0
0
0
0
0
0
$0006
Unimplemented
Read:
Write:
$0007
Data Direction Register D
(DDRD)
Read:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
Write:
Reset:
0
0
0
0
0
0
0
0
$0008
↓
$0009
Unimplemented
Read:
Write:
$000A
Port D Control Register
(PDCR)
Read:
0
0
0
0
SLOWD7 SLOWD6
PTDPU7
PTDPU6
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
R
= Reserved
Figure 2-2. Control, Status, and Data Registers (Sheet 1 of 5)
相關(guān)PDF資料 |
PDF描述 |
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| JDBM-7W2P | JDM TYPE COAXIAL TERMINAL CONNECTORS |
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參數(shù)描述 |
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