參數(shù)資料
型號(hào)： ISPLSI1032EA-100
廠(chǎng)商： Lattice Semiconductor Corporation
英文描述： In-System Programmable High Density PLD
中文描述： 在系統(tǒng)可編程高密度可編程邏輯器件
文件頁(yè)數(shù)： 9/16頁(yè)
文件大小： 172K
代理商： ISPLSI1032EA-100
9
Specifications
ispLSI 1032EA
t
ob
t
sl
1. Internal Timing Parameters are not tested and are for reference only.
Table 2-0037A/1032EA
Outputs
UNITS
-170
MIN.
MIN.
MAX.
MAX.
DESCRIPTION
#
PARAM.
50 Output Buffer Delay
51 Output Buffer Delay, Slew Limited Adder
ns
ns
t
oen
t
odis
t
goe
52 I/O Cell OE to Output Enabled
53 I/O Cell OE to Output Disabled
54 Global OE
ns
ns
ns
t
gy0
t
gy1/2
t
gcp
t
ioy2/3
t
iocp
55 Clock Delay, Y0 to Global GLB Clock Line (Ref. clk)
ns
Global Reset
t
gr
Clocks
60 Global Reset to GLB and I/O Registers
ns
56 Clock Delay, Y1 or Y2 to Global GLB Clock Line
57 Clock Delay, Clock GLB to Global GLB Clock Line
58 Clock Delay, Y2 or Y3 to I/O Cell Global Clock Line
59 Clock Delay, Clock GLB to I/O Cell Global Clock Line
ns
ns
ns
ns
-200
—
—
—
—
—
0.6
0.9
0.8
0.0
0.8
—
0.7
5.0
2.9
2.9
1.6
0.6
0.0
0.9
1.8
0.0
2.8
—
—
—
—
—
0.9
0.9
0.8
0.0
0.8
—
0.9
5.0
3.3
3.3
2.6
0.9
0.4
0.9
1.8
0.0
2.8
Internal Timing Parameters
1
相關(guān)PDF資料
PDF描述
ISPLSI1032EA-100LT100 In-System Programmable High Density PLD
ISPLSI1032EA-125 In-System Programmable High Density PLD
ISPLSI1032EA-125LT100 In-System Programmable High Density PLD
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