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參數(shù)資料
| 型號： | ISL98003INZ-110 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 29/31頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC AFE 3CH 8BIT 110MHZ 80EPTQFP |
| 標準包裝： | 119 |
| 位數(shù)： | 8 |
| 通道數(shù)： | 3 |
| 功率（瓦特）： | 1.1W |
| 電壓 - 電源，模擬： | 1.8V，3.3V |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 2 V |
| 封裝/外殼： | 80-TQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 80-TQFP-EP（12x12） |
| 包裝： | 托盤 |
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FN6760.0
September 12, 2008
Pinout
ISL98003
(80 LD EPTQFP)
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VD3.3
R7
R6
R5
R4
R3
VD1.8
R2
R1
R0
VD3.3
DATACLK
HSOUT
VSYNCOUT
HSYNCOUT
SCL
SDA
COASTIN
CLAMPIN
RESET
CLOCKINVIN
DTEST3
EXTCLKIN
DTEST2
HSYNCIN0
VSYNCIN0
HSYNCIN1
VSYNCIN1
DTEST1
XTALOUT
VPLLD1.8
VR
EF
BLUE
SO
G
IN
0
G
IN
0
V
A3
.3
B
IN
0
R
IN
1
V
A1
.8
SO
G
IN
1
VREF
G
R
EEN
G
IN
1
B
IN
1
V
A3
.3
V
A1
.8
VR
EF
RED
V
A1
.8
V
A3
.3
V
D3
.3
B7
B6
B5
B4
B3
V
D1
.8
B2
B1
B0
V
D3
.3
G7
G6
G5
G3
G4
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R
IN
0
V
ADC
D1
.8
VP
LL
A3
.3
XT
A
L
IN
57
58
59
60
V
D1
.8
G2
G1
G0
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80
INT
DE
FIELD
TESTOUT
VD1.8
XCLKOUT
DTEST4
DTEST5
GND
GND CONNECTED TO EXPOSED PAD
Pin Descriptions
SYMBOL
DESCRIPTION
RIN0, 1
Analog inputs. Red channels. AC-couple through 0.1F.
GIN0, 1
Analog inputs. Green channels. AC-couple through 0.1F.
BIN0, 1
Analog inputs. Blue channels. AC-couple through 0.1F.
VREFRED,
VREFGREEN,
VREFBLUE
Analog inputs. Reference voltage for ADCs. Tie to 1.8V reference voltage (VA1.8 is acceptable if low noise). Decouple with
0.1F capacitor to GNDA.
SOGIN0, 1
Analog inputs. Sync on Green. Connect to corresponding Green channel video source through a 0.01F capacitor in series
with a 500
Ω resistor.
HSYNCIN0, 1
Digital high impedance 3.3V inputs with 240mV hysteresis. Connect to corresponding channel's HSYNC source. For 5V
signals divide input with a 1k/1.9k divider. Place the divider as close as possible to the device pin. Place a 50pF capacitor
in parallel with the 1k resistor to reduce the filtering effect of the divider.
VSYNCIN0, 1
Digital high impedance 3.3V inputs with 240mV hysteresis. Connect to corresponding channel's VSYNC source. For 5V
signals divide input with a 1k/1.9k divider. Place the divider as close as possible to the device pin. Place a 50pF capacitor
in parallel with the 1k resistor to reduce the filtering effect of the divider.
COASTIN
Digital 3.3V input. When this input is high and external COAST is selected, the PLL will coast, ignoring all transitions on
the active channel’s HSYNC/SOG.
ISL98003
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