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參數(shù)資料
| 型號： | ISL84684 |
| 廠商： | Intersil Corporation |
| 元件分類： | DRAM |
| 英文描述： | 1024 x 36 synchronous FIFO Memory 132-BQFP 0 to 70 |
| 中文描述： | 超低導通電阻，低電壓，單電源，雙路SPDT模擬開關(guān) |
| 文件頁數(shù)： | 5/11頁 |
| 文件大?。?/td> | 406K |
| 代理商： | ISL84684 |
5
Test Circuits and Waveforms
Logic input waveform is inverted for switches that have the opposite
logic sense.
FIGURE 1A. MEASUREMENT POINTS
Repeat test for all switches. C
L
includes fixture and stray
capacitance.
V
OUT
V(NO or NC)
FIGURE 1B. TEST CIRCUIT
FIGURE 1. SWITCHING TIMES
FIGURE 2A. MEASUREMENT POINTS
FIGURE 2B. TEST CIRCUIT
FIGURE 2. CHARGE INJECTION
FIGURE 3A. MEASUREMENT POINTS
Repeat test for all switches. C
L
includes fixture and stray
capacitance.
FIGURE 3B. TEST CIRCUIT
FIGURE 3. BREAK-BEFORE-MAKE TIME
50%
t
r
< 20ns
t
f
< 20ns
t
OFF
90%
V
INH
0V
V
NO
V
INL
t
ON
LOGIC
INPUT
SWITCH
INPUT
SWITCH
OUTPUT
90%
V
OUT
R
ON
(
L
)
---------+
=
SWITCH
INPUT
LOGIC
INPUT
V
OUT
R
L
50
C
L
35pF
COM
NO or NC
IN
GND
V+
C
V
OUT
V
OUT
ON
OFF
ON
Q =
V
OUT
x C
L
SWITCH
OUTPUT
LOGIC
INPUT
V
INH
V
INL
C
L
V
OUT
R
G
V
G
GND
COM
NO or NC
V+
C
LOGIC
INPUT
IN
Repeat test for all switches.
90%
V
INH
V
INL
t
D
LOGIC
INPUT
SWITCH
OUTPUT
V
OUT
0V
LOGIC
INPUT
IN
COM
R
L
50
C
L
35pF
V
OUT
NO
NC
V+
GND
V
NX
C
ISL84684
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PDF描述 |
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參數(shù)描述 |
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