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參數(shù)資料
| 型號： | IJ80C52XXX-16:R |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| 封裝： | LCC-44 |
| 文件頁數(shù)： | 7/182頁 |
| 文件大?。?/td> | 2994K |
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104
1477K–AVR–08/10
ATtiny26(L)
Bits 2..0 – ADPS2..0: ADC Prescaler Select Bits
These bits determine the division factor between the CK frequency and the input clock to the
ADC.
ADC Data Register –
ADCL and ADCH
ADLAR = 0
ADLAR = 1
When an ADC conversion is complete, the result is found in these two registers. The ADLAR bit
in ADMUX affect the way the result is read from the registers. If ADLAR is set, the result is left
adjusted. If ADLAR is cleared (default), the result is right adjusted. If the result is left adjusted
and no more than 8-bit precision is required, it is sufficient to read ADCH. Otherwise, ADCL
must be read first, then ADCH.
ADC9..0: ADC Conversion Result
These bits represent the result from the conversion. For differential channels, this is the absolute
value after gain adjustment, as indicated in Table 46 on page 102. For single ended channels,
$000 represents analog ground, and $3FF represents the selected reference voltage minus one
LSB.
Table 47. ADC Prescaler Selections
ADPS2
ADPS1
ADPS0
Division Factor
00
0
2
00
1
2
01
0
4
01
1
8
10
0
16
10
1
32
11
0
64
11
1
128
Bit
1514131211
10
9
8
$05 ($25)
–
ADC9
ADC8
ADCH
$04 ($24)
ADC7
ADC6
ADC5
ADC4
ADC3
ADC2
ADC1
ADC0
ADCL
765
4321
0
Read/Write
RRRR
Initial Value
000
0000
0
000
0000
0
Bit
151413121110
9
8
$05 ($25)
ADC9
ADC8
ADC7
ADC6
ADC5
ADC4
ADC3
ADC2
ADCH
$04 ($24)
ADC1
ADC0
–
–––––
ADCL
765
43210
Read/Write
RRRR
Initial Value
000
00000
000
00000
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PDF描述 |
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