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參數(shù)資料
| 型號(hào)： | IJ80C52XXX-16:R |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| 封裝： | LCC-44 |
| 文件頁數(shù)： | 150/182頁 |
| 文件大小： | 2994K |
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1477K–AVR–08/10
ATtiny26(L)
AVR CPU Core
Architectural
Overview
The fast-access Register File concept contains 32 x 8-bit general purpose working registers with
a single clock cycle access time. This means that during one single clock cycle, one ALU (Arith-
metic Logic Unit) operation is executed. Two operands are output from the Register File, the
operation is executed, and the result is stored back in the Register File – in one clock cycle.
Six of the 32 registers can be used as 16-bit pointers for indirect memory access. These pointers
are called the X-, Y-, and Z-pointers, and they can address the Register File and the Flash pro-
gram memory.
Figure 2. The ATtiny26(L) AVR Enhanced RISC Architecture
The ALU supports arithmetic and logic functions between registers or between a constant and a
register. Single register operations are also executed in the ALU. Figure 2 shows the
ATtiny26(L) AVR Enhanced RISC microcontroller architecture. In addition to the register opera-
tion, the conventional memory addressing modes can be used on the Register File as well. This
is enabled by the fact that the Register File is assigned the 32 lowermost Data Space addresses
($00 - $1F), allowing them to be accessed as though they were ordinary memory locations.
The I/O memory space contains 64 addresses for CPU peripheral functions as Control Regis-
ters, Timer/Counters, A/D Converters, and other I/O functions. The I/O Memory can be
accessed directly, or as the Data Space locations following those of the Register File, $20 - $5F.
The AVR uses a Harvard architecture concept with separate memories and buses for program
and data memories. The program memory is accessed with a two stage pipelining. While one
instruction is being executed, the next instruction is pre-fetched from the program memory. This
1024 x 16
Program
FLASH
Instruction
Register
Instruction
Decoder
Program
Counter
Control Lines
32 x 8
General
Purpose
Registers
ALU
Direct
Addressing
Indirect
Addressing
Status
and Test
Control
Registers
Interrupt
Unit
2 x 8-bit
Timer/Counter
Universal
Serial Interface
Watchdog
Timer
Analog
Comparator
I/O Lines
8-bit Data Bus
ISP Unit
ADC
128 x 8
SRAM
128 byte
EEPROM
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MR80C32-25/883R | 8-BIT, 25 MHz, MICROCONTROLLER, CQCC44 |
| MR80C52CXXX-12SBR | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44 |
| MR80C32-16SC | 8-BIT, 16 MHz, MICROCONTROLLER, CQCC44 |
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參數(shù)描述 |
|---|---|
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| IJA35A-001-EVKIT-S1 | 功能描述:iJA12035 iJA DC/DC Converter 1, Non-Isolated Outputs Evaluation Board 制造商:tdk-lambda americas inc. 系列:iJA 零件狀態(tài):新產(chǎn)品 主要用途:DC/DC 轉(zhuǎn)換器 輸出和類型:1，非隔離 功率 - 輸出:- 電壓 - 輸出:0.6 V ~ 3.3 V 電流 - 輸出:35A 電壓 - 輸入:8 V ~ 14 V 穩(wěn)壓器拓?fù)?- 頻率 - 開關(guān):- 板類型:完全填充 所含物品:板，線纜 使用的 IC/零件:iJA12035 標(biāo)準(zhǔn)包裝:1 |
| IJB12060A006V-003-R | 功能描述:DC/DC CONVERTER 0.6-2V 120W 制造商:tdk-lambda americas inc. 系列:iJB 包裝:剪切帶（CT） 零件狀態(tài):有效 類型:非隔離 PoL 模塊，數(shù)字 輸出數(shù):1 電壓 - 輸入（最小值）:8V 電壓 - 輸入（最大值）:14V 電壓 - 輸出 1:0.6 ~ 2 V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:60A 功率（W） - 制造系列:- 電壓 - 隔離:- 應(yīng)用:ITE（商業(yè)） 特性:遠(yuǎn)程開/關(guān)，OCP，OVP 安裝類型:表面貼裝 封裝/外殼:28-SMD 模塊 大小/尺寸:1.06" 長 x 0.95" 寬 x 0.38" 高（26.8mm x 24.1mm x 9.7mm） 工作溫度:-40°C ~ 120°C 效率:93% 功率（W） - 最大值:- 標(biāo)準(zhǔn)包裝:1 |
| IJB60A-003-EVKIT-S1 | 功能描述:IJB EVAL BOARD (SINGLE) 制造商:tdk-lambda americas inc. 系列:iJB 零件狀態(tài):在售 主要用途:DC/DC 轉(zhuǎn)換器 輸出和類型:- 電壓 - 輸出:- 電流 - 輸出:- 電壓 - 輸入:- 穩(wěn)壓器拓?fù)?- 頻率 - 開關(guān):- 板類型:完全填充 所含物品:板 使用的 IC/零件:iJB 標(biāo)準(zhǔn)包裝:1 |
| IJBEB2 | 功能描述:iJB12060A007V-001-R iJB DC/DC, Step Down 1, Non-Isolated Outputs Evaluation Board 制造商:tdk-lambda americas inc. 系列:iJB 零件狀態(tài):有效 主要用途:DC/DC，步降 輸出和類型:1，非隔離 功率 - 輸出:- 電壓 - 輸出:0.6 V ~ 2 V 電流 - 輸出:110A 電壓 - 輸入:8 V ~ 14 V 穩(wěn)壓器拓?fù)?降壓 頻率 - 開關(guān):- 板類型:完全填充 所含物品:板，線纜 使用的 IC/零件:iJB12060A007V-001-R 標(biāo)準(zhǔn)包裝:1 |
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